检索结果-内蒙古大学图书馆

通信学报 2007年第8期28卷 61-66页

作者：陈赟曾晓洋林一帆向波邓运松复旦大学专用集成电路与系统国家重点实验室上海201203

在完全符合数字电视地面传输中国国家标准(DTMB)的芯片系统中,实现了一个码长为7 493bit,同时支持3种码率(0.4,0.6,0.8)的非规则LDPC码解码器。在该设计中,使用了一种新的存储器调用的控制策略,在只比单码率最多增加不到5%的存储器的情... 详细信息

在完全符合数字电视地面传输中国国家标准(DTMB)的芯片系统中,实现了一个码长为7 493bit,同时支持3种码率(0.4,0.6,0.8)的非规则LDPC码解码器。在该设计中,使用了一种新的存储器调用的控制策略,在只比单码率最多增加不到5%的存储器的情况下,实现了3种码率存储器的复用。在最大迭代次数为15次的情况下,可以达到150Mbit/s的高吞吐率,而在DTMB中所需的50Mbit/s数据率要求下,迭代次数可高达45次。还给出了FPGA的综合报告和基于SMIC 0.13μm CMOS工艺下的解码器版图。

关键词：数字电视 VLSI LDPC 非规则码

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一种用于数码视频相机的实时自动聚焦算法

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光电工程 2008年第8期35卷 139-144页

作者：盛云秦亚杰洪志良复旦大学专用集成电路与系统国家重点实验室上海201203

本文针对数码视频相机的噪声大,主体位置不确定性及实时性要求高等特点,详细讨论了传统自动对焦算法的缺陷并提出了一种新的自动对焦算法。该算法采用一种新的可有效抑制高频噪声的对焦量函数——高斯一阶导数(FDOG)来正确评价图像对焦... 详细信息

本文针对数码视频相机的噪声大,主体位置不确定性及实时性要求高等特点,详细讨论了传统自动对焦算法的缺陷并提出了一种新的自动对焦算法。该算法采用一种新的可有效抑制高频噪声的对焦量函数——高斯一阶导数(FDOG)来正确评价图像对焦趋势;支持最近主体优先的感兴趣区域自动选择,使得系统可以自动找到主体所在位置进行对焦;结合爬山法,二叉搜索和插值拟合进行对焦搜索,相比传统的两段爬山法,搜索效率提高了40%;通过对聚焦后的图像进行监视,支持视频模式下的动态自动对焦。该算法在一个数码视频相机平台上实现,实验结果验证了算法的优点,适用于高性能数码视频相机。

关键词：自动对焦数码视频相机高斯一阶导数最近主体优先感兴趣区域二叉搜索

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一种FPGA抗辐射工艺映射方法研究

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电子学报 2011年第11期39卷 2507-2512页

作者：陈志辉章淳王颖王伶俐复旦大学专用集成电路与系统国家重点实验室上海201203

提出一种基于部分TMR和逻辑门掩盖的FPGA抗辐射工艺映射算法FDRMap,以及一个基于蒙特卡洛仿真的并行错误注入和仿真平台.该平台和算法已经应用到复旦大学自主研发的FPGA芯片FDP4软件流程的工艺映射模块.实验结果表明,FDRMap能够在增加14... 详细信息

提出一种基于部分TMR和逻辑门掩盖的FPGA抗辐射工艺映射算法FDRMap,以及一个基于蒙特卡洛仿真的并行错误注入和仿真平台.该平台和算法已经应用到复旦大学自主研发的FPGA芯片FDP4软件流程的工艺映射模块.实验结果表明,FDRMap能够在增加14.06%LUT数目的前提下,降低电路的抗辐射关键度32.62%;与单纯采用部分TMR的方法相比,在节省12.23%的LUT数目同时,还能额外降低电路关键度12.44%.

关键词：现场可编程门阵列工艺映射抗辐射错误仿真单粒子翻转

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高速Viterbi译码器的VLSI设计与实现

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计算机研究与发展 2007年第12期44卷 2143-2148页

作者：李庆邓运松曾晓洋顾叶华复旦大学专用集成电路与系统国家重点实验室上海201203

在优化结构的基础上,实现了一种回溯长度为64的(2,1,7)高速Viterbi译码器.该译码器采用改进的加比选单元(ACS),降低了硬件复杂度,提高了时钟运行频率.改进的回溯单元采用了分块循环存储器,对数据读取结构进行改进,提高了译码器的数据吞... 详细信息

在优化结构的基础上,实现了一种回溯长度为64的(2,1,7)高速Viterbi译码器.该译码器采用改进的加比选单元(ACS),降低了硬件复杂度,提高了时钟运行频率.改进的回溯单元采用了分块循环存储器,对数据读取结构进行改进,提高了译码器的数据吞吐率.基于SMIC0.18μmCMOS工艺,该译码器最高工作时钟频率可达180MHz,等效逻辑门约为28683门.经过验证比较,结果表明实现的高速Viterbi译码器在各个指标上如实现面积、回溯长度和约束长度比现有的各种方案有较大幅度的提高,因此该译码器在数字通信领域具有良好的应用前景如DTV和HDTV.

关键词：维特比译码器加比选高速回溯 HDTV

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针对MUX-LUT混合结构的FPGA工艺映射算法研究

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计算机辅助设计与图形学学报 2004年第1期16卷 98-104页

作者：温宇杰童家榕复旦大学专用集成电路与系统国家重点实验室上海200433

针对具有MUX LUT混合结构的FPGA芯片 ,提出一种对其进行工艺映射的面积优化映射算法该算法的内容包括逻辑门电路到MUX网络的转换方法 ,MUX网络到FPGA芯片逻辑单元的映射方法文中算法采用模式匹配的方法除去电路中的冗余MUX ,以减少... 详细信息

针对具有MUX LUT混合结构的FPGA芯片 ,提出一种对其进行工艺映射的面积优化映射算法该算法的内容包括逻辑门电路到MUX网络的转换方法 ,MUX网络到FPGA芯片逻辑单元的映射方法文中算法采用模式匹配的方法除去电路中的冗余MUX ,以减少映射结果的面积开销应用测试电路分别对该算法和Xilinx的Foun dation系统对XC4 0 0 3E芯片的工艺映射结果进行了比较测试。

关键词： MUX-LUT混合结构 FPGA芯片工艺映射模式匹配现场可编程门阵列

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一种堆叠式3D IC的最小边界热分析方法

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电子学报 2012年第5期40卷 865-870页

作者：余慧吴昊陈更生童家榕复旦大学专用集成电路与系统国家重点实验室上海200433

目前的热分析工具仅仅支持单芯片的热分析,而堆叠式的三维芯片(3D IC)在同一封装中包含多个堆叠的芯片,对芯片的散热和温度管理提出了更高的要求,并且在热分析过程中需要处理复杂的边界条件.本文提出的最小边界法可以准确且有效地处理... 详细信息

目前的热分析工具仅仅支持单芯片的热分析,而堆叠式的三维芯片(3D IC)在同一封装中包含多个堆叠的芯片,对芯片的散热和温度管理提出了更高的要求,并且在热分析过程中需要处理复杂的边界条件.本文提出的最小边界法可以准确且有效地处理堆叠式3D IC的边界条件,简化了三维芯片封装的热模型;同时,本文提出在堆叠式3D IC的稳态热量分析中通过将连接点分类、采用预处理矩阵的方法加速整个全局热传导矩阵的求解过程,从而简化热分析流程.实验结果表明:将有限元方法作为基本的热分析方法,用最小边界法处理堆叠式3D IC,可以准确分析芯片的热分布;同时通过高效的预处理矩阵可以减少共轭梯度法求解中90%的迭代次数.

关键词：热分析有限元方法 3D IC 最小边界

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带权值目标点的可见覆盖求解算法

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计算机辅助设计与图形学学报 2014年第3期26卷 364-369页

作者：董君朱恒亮曾璇复旦大学专用集成电路与系统国家重点实验室上海201203

针对传统的艺术画廊模型及其模型的变形在实际应用中无法处理诸如可用守卫数受限、只需监控离散目标点等情形,提出一种基于带权值目标点的可见覆盖的变形模型及其求解算法.首先利用角扫描技术得到每个目标点的可见多边形,然后通过对这... 详细信息

针对传统的艺术画廊模型及其模型的变形在实际应用中无法处理诸如可用守卫数受限、只需监控离散目标点等情形,提出一种基于带权值目标点的可见覆盖的变形模型及其求解算法.首先利用角扫描技术得到每个目标点的可见多边形,然后通过对这些可见多边形进行几何求交、几何求差操作来得到若干等价目标可见区域,再依据每个区域对应的可见目标点集将所提出的变形模型转化为经典的集合最大权值覆盖问题,最后利用整数线性规划方法对其求解,得到最终需要的守卫数及放置位置.大量的实验结果表明,该算法是正确和有效的.

关键词：艺术画廊问题可见多边形带权值目标点计算几何整数线性规划

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改进的JPEG2000位平面编解码算法实现

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计算机辅助设计与图形学学报 2005年第11期17卷 2471-2476页

作者：陈坚黄全平周荣政洪志良复旦大学专用集成电路与系统国家重点实验室上海200433

针对JPEG2000中位平面编解码算法复杂、运算量大的问题,对其进行了优化,省去了其中的冗余操作.在引入特殊的数据存储格式和状态信息寄存器组的基础上,提出一种高效的存储器管理方法,简化了编解码过程,实现了数据处理的流水线操作,也大... 详细信息

针对JPEG2000中位平面编解码算法复杂、运算量大的问题,对其进行了优化,省去了其中的冗余操作.在引入特殊的数据存储格式和状态信息寄存器组的基础上,提出一种高效的存储器管理方法,简化了编解码过程,实现了数据处理的流水线操作,也大大减少了对存储器的读写次数.该算法采用0.25μm CMOS数字工艺流片,并被系统集成于数码相机芯片中.测试结果显示,改进后的算法有效地提高了位平面编解码的效率,具有存储器少、复杂度低的优点.

关键词： JPEG2000 位平面编解码数码相机

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基为16的高速Montgomery模乘法器VLSI设计

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通信学报 2006年第4期27卷 107-113页

作者：范益波曾晓洋于宇复旦大学专用集成电路与系统国家重点实验室上海200433

针对Tenca-Todorov-Ko?提出的基为8,按字运算的Montgomery乘法器提出了一种改进方案。该方案在不增加硬件开销的基础上采用基为16的设计,相比Tenca-Todorov-Ko?的设计,平均性能提高26%。同时,在硬件上一方面通过调整数据通路以缩短关键... 详细信息

针对Tenca-Todorov-Ko?提出的基为8,按字运算的Montgomery乘法器提出了一种改进方案。该方案在不增加硬件开销的基础上采用基为16的设计,相比Tenca-Todorov-Ko?的设计,平均性能提高26%。同时,在硬件上一方面通过调整数据通路以缩短关键路径延迟,达到时钟频率的提升;另一方面,在FIFO设计中对输入数据进行预处理,最终能节省一半的存储器开销。改进后的设计能应用于各种长度的模乘运算和RSA加密。最后,采用上述设计思想,基于0.25μmCMOS标准单元工艺,设计了一款2048bit的RSA测试芯片。该芯片在125MHz的时钟频率下做一次2048bit模幂的时间为28ms。

关键词：信息安全高速Montgomery乘法器 VLSI 密码算法

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高速、可配置RSA密码协处理器的VLSI设计

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计算机研究与发展 2006年第6期43卷 1076-1082页

作者：范益波曾晓洋于宇复旦大学专用集成电路与系统国家重点实验室上海200433

通过算法级分析和对比RSA原始算法以及改进型模幂模乘算法,提出了一种双重流水线结构的RSA密码协处理器体系结构,该结构具备高速、可配置性能·基于该体系结构,可以根据不同的用户需求,方便地设计出支持各种速度和密钥长度的RSA密... 详细信息

通过算法级分析和对比RSA原始算法以及改进型模幂模乘算法,提出了一种双重流水线结构的RSA密码协处理器体系结构,该结构具备高速、可配置性能·基于该体系结构,可以根据不同的用户需求,方便地设计出支持各种速度和密钥长度的RSA密码处理器·该体系结构尤其适用于设计高速、高位宽RSA密码芯片;同时其可配置性能也可以满足低速、高位数、高安全性RSA系统的市场需求·另外,基于该体系结构设计的RSA加密IP,非常适合SoC的芯片设计·最后,基于该体系结构设计了一款高速1024b RSA密码加密芯片,采用0·18μm标准单元库设计,实现结果显示,芯片在150MHz时钟频率下能完成每秒5000次1024b RSA加密运算,是国内同类产品中速度最快的·

关键词： RSA 高速可配置加密芯片 VLSI

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