检索结果-内蒙古大学图书馆

A 2.4GHz Quadrature Output Frequency Synthesizer

Journal of Semiconductors 2005年第10期26卷 1910-1915页

作者：衣晓峰方晗杨雨佳洪志良复旦大学专用集成电路与系统国家重点实验室上海200433

A design and implementation for a 2.4GHz quadrature output frequency synthesizer intended for bluetooth in 0. 35μm CMOS technology are presented. A differentially controlled quadrature voltage-controlled oscillator （QVCO） is employed to generate quadrature （I/Q） signals. A second-order loop filter, with a unit gain transconductance amplifier having the performance of a third-order loop filter,is exploited for low cost. The measured spot phase noise is -106.15dBc/Hz@ 1MHz. Close-in phase noise is less than -70dBc/Hz. The synthesizer consumes 13.5mA under a 3.3V voltage supply. The core size is 1.3mm×0. 8mm.

关键词： frequency synthesizer phase locked loop quadrature VCO phase noise bluetooth

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一种10bit 50MS/s低功耗流水线模数转换器

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复旦学报（自然科学版） 2011年第4期50卷 450-456页

作者：周文君张科李文宏复旦大学专用集成电路与系统国家重点实验室上海201203

设计了一个10 bit精度,50 MS/s采样频率的流水线型模数转换器,通过运算放大器共享和省略采样保持实现低功耗.第1级为单比特输出,它能够在将信号摆幅减半的同时保持信噪比不衰减,减半的摆幅使得运放直流增益和带宽要求以及电容匹配要求降... 详细信息

设计了一个10 bit精度,50 MS/s采样频率的流水线型模数转换器,通过运算放大器共享和省略采样保持实现低功耗.第1级为单比特输出,它能够在将信号摆幅减半的同时保持信噪比不衰减,减半的摆幅使得运放直流增益和带宽要求以及电容匹配要求降低.由于采用运放共享技术,该设计只使用了4个运放,功耗相比传统结构降低1/3.采用0.35μm 2P4M CMOS工艺设计,在3.3 V电源电压下约消耗33 mW功耗,核心部分面积为2.2 mm2,采样频率50 MS/s,输入频率5 MHz时,SFDR为80.27 dB,THD为-77.45 dB,SNDR为61.17 dB.

关键词：模数转换器流水线低功耗运放共享无采样保持

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一种高速FPGA配置电路设计

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复旦学报（自然科学版） 2013年第4期52卷 479-485页

作者：毛劲松叶海江周灏王健来金梅复旦大学专用集成电路与系统国家重点实验室上海201203

针对当前FPGA芯片编程下载(配置)电路结构上的不足导致位流下载回读吞吐率较低问题,设计了一种流水线编程下载电路结构,将位流下载分两级流水线并行实施,第一级通过快速解析位流的指令集实现数据包的分拆,第二级将解析出的数据包送达内... 详细信息

针对当前FPGA芯片编程下载(配置)电路结构上的不足导致位流下载回读吞吐率较低问题,设计了一种流水线编程下载电路结构,将位流下载分两级流水线并行实施,第一级通过快速解析位流的指令集实现数据包的分拆,第二级将解析出的数据包送达内部编程点相应的字线与位线.采用与电路结构兼容的32位并行CRC32技术校验下载位流,以增强位流下载可靠性,并采用帧ECC电路对回读位流进行单比特纠错与多比特检错(SECDED).验证结果表明,该设计在内部振荡器频率为150MHz的情况下外部配置端口的最高吞吐率为3 680Mbps,在内部振荡器频率为200MHz的情况下最高吞吐率为4 896Mbps.

关键词：现场可编程逻辑门阵列编程下载吞吐率 CRC32 ECC

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适用于多种无线通信标准的宽带CMOS频率综合器

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复旦学报（自然科学版） 2012年第1期51卷 7-14页

作者：周谨李巍黄德平李宁任俊彦复旦大学专用集成电路与系统国家重点实验室上海201203

采用小数分频锁相环路、正交单边带混频器和除2除法器设计了一款全集成CMOS频率综合器,以满足多种无线通信标准的要求.提出基于双模压控振荡器(DMVCO)的频率综合器架构,一方面能够通过除2除法器覆盖3GHz以下的无线通信频段,另一方面DMVC... 详细信息

采用小数分频锁相环路、正交单边带混频器和除2除法器设计了一款全集成CMOS频率综合器,以满足多种无线通信标准的要求.提出基于双模压控振荡器(DMVCO)的频率综合器架构,一方面能够通过除2除法器覆盖3GHz以下的无线通信频段,另一方面DMVCO自身又替代了额外的多相滤波器来抑制混频器引入的镜像杂散.频率自动校准电路能对压控振荡器的频率进行快速、准确的校准.频率综合器采用TSMC 0.13μmCMOS工艺进行设计.仿真结果表明,在输出频率为900MHz时频偏在0.6MHz处,频率综合器的相位噪声为-122dBc/Hz;在功耗不大于56mW的情况下,频率综合器实现了0.4～6GHz的频率覆盖范围.

关键词：多模无线通信压控振荡器频率自动校准频率综合器

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一个面积和功耗优化且适用于10/100 Base-T以太网的CMOS时钟恢复电路

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Journal of Semiconductors 2003年第6期24卷 643-648页

作者：王彦叶凡李联郑增钰复旦大学专用集成电路与系统国家重点实验室上海200433

提出了一个新的用于 10 / 10 0 Base- T以太网中面积和功耗优化的时钟恢复电路 .它采用双环路的结构 ,加快了锁相环路的捕获和跟踪速度 ;采用复用的方式 ,通过选择信号控制电路可分别在 10 Mbps或 10 0 Mbps模式下独立工作且能方便地实... 详细信息

提出了一个新的用于 10 / 10 0 Base- T以太网中面积和功耗优化的时钟恢复电路 .它采用双环路的结构 ,加快了锁相环路的捕获和跟踪速度 ;采用复用的方式 ,通过选择信号控制电路可分别在 10 Mbps或 10 0 Mbps模式下独立工作且能方便地实现模式间的互换 ,与采用两个独立的 CDR电路相比节省了一半的面积 ;同时 ,电路中采用一般的延迟单元来取代 DL L,并能保证环路性能不随工艺温度等条件引起的延迟单元、延迟时间的变化而变化 ,从而节省了功耗 .Hspice模拟结果显示 ,在 Vdd=2 .5 V时 ,10 0 Mbps模式下电路的功耗约为 75 m W,稳态相差为 0 .3 ns;10 Mbps模式时电路功耗为 5 8m W,稳态相差为 0 .

关键词： 10/100 Base—T DLL 时钟恢复电路

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一种基于扩展查询表的可编程逻辑单元

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计算机学报 2003年第10期26卷 1372-1378页

作者：郭斌林童家榕复旦大学专用集成电路与系统国家重点实验室上海200433

　通过把 3输入查询表 ,展开为 7输入扩展查询表 ,提出了一种基于扩展查询表的可编程逻辑单元新结构 .通过对扩展查询表进行功能扩展和优化 ,并加入专用快速进位链、专用级联链等功能 ,使得该结构不仅可实现任意3输入 ,部分 4～ 7输入函... 详细信息

　通过把 3输入查询表 ,展开为 7输入扩展查询表 ,提出了一种基于扩展查询表的可编程逻辑单元新结构 .通过对扩展查询表进行功能扩展和优化 ,并加入专用快速进位链、专用级联链等功能 ,使得该结构不仅可实现任意3输入 ,部分 4～ 7输入函数 ,而且也能实现快速的算术及高扇入的逻辑 .整个单元组合部分的元件开销小于一个 4输入的查询表 .与相关商用FPGA单元结构进行的比较表明 ,该文提出的单元结构不仅占用的芯片面积较小 ,而且在速度和逻辑实现的能力上都有较大的优势 .

关键词： FPGA 可编程逻辑单元扩展查询表可编程逻辑器件

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一种开关电容型直流变换器的系统研究与设计

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电路与系统学报 2008年第4期13卷 124-129页

作者：邵滨杨雨佳王颖洪志良复旦大学专用集成电路与系统国家重点实验室上海200433

本文利用状态空间方程法对一种开关电容型直流变换器系统进行了稳态和动态特性的研究,该直流变换器采用了具有分段转换系数的多级开关电容电荷泵结构。根据研究结果提出系统在控制方法选择(电流控制和脉冲频率调制)和频率补偿方面的优... 详细信息

本文利用状态空间方程法对一种开关电容型直流变换器系统进行了稳态和动态特性的研究,该直流变换器采用了具有分段转换系数的多级开关电容电荷泵结构。根据研究结果提出系统在控制方法选择(电流控制和脉冲频率调制)和频率补偿方面的优化办法。基于这些优化办法,本文给出一种高效率、低纹波和低成本的开关电容型直流变换器的系统与电路设计,系统的晶体管级仿真结果达到目前便携式电子产品对电源管理芯片的要求。

关键词：直流变换器状态空间方程电流控制脉冲频率调制片上电流探测频率补偿

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一种应用于超高速ADC中6G/8GHz的高精度正交时钟产生电路

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复旦学报（自然科学版） 2014年第4期53卷 458-465,474,F0002页

作者：蒋健兵马顺利周光耀叶凡任俊彦复旦大学专用集成电路与系统国家重点实验室上海201203

正交时钟被广泛地用在正交频分复用（OFDM）通信系统的时间交织模拟数字转换器（ADC）中.正交信号的相位偏差和时钟抖动对整个系统都有着重要的影响.针对时间交织ADC的应用需求,提出一种宽带的输出相位可调的正交注入锁定分频器,通过调... 详细信息

正交时钟被广泛地用在正交频分复用（OFDM）通信系统的时间交织模拟数字转换器（ADC）中.正交信号的相位偏差和时钟抖动对整个系统都有着重要的影响.针对时间交织ADC的应用需求,提出一种宽带的输出相位可调的正交注入锁定分频器,通过调节注入信号和耦合信号的能量来改善因器件失配和工艺偏差等造成的正交信号的相位误差.在此基础上设计了一个基于LC压控振荡器的电荷泵型锁相环.该锁相环采用TSMC65nm工艺设计,正交时钟的频率输出范围是5.8-6.5GHz和7.1-8.3GHz,正交相位的平均误差小于0.26°,满足系统设计的预设指标.

关键词：锁相环正交时钟相位可调注入锁定分频器

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TDS-OFDM时变信道估计和均衡的BEM-LSQR方法

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复旦学报（自然科学版） 2013年第3期52卷 328-333页

作者：王亦之陈赟曾晓洋复旦大学专用集成电路与系统国家重点实验室上海201203

中国地面高清数字电视(DTMB)在高速移动环境下的应用日益广泛.利用其多载波模式下的时域同步正交频分复用(TDS-OFDM)帧结构,提出三种利用基展开模型(BEM)的针对不同场合的时变信道估计方法,并利用正交分解最小二乘(LSQR)对帧体进行均衡... 详细信息

中国地面高清数字电视(DTMB)在高速移动环境下的应用日益广泛.利用其多载波模式下的时域同步正交频分复用(TDS-OFDM)帧结构,提出三种利用基展开模型(BEM)的针对不同场合的时变信道估计方法,并利用正交分解最小二乘(LSQR)对帧体进行均衡.第一种信道估计方法针对400Hz及以下多普勒频移,分别估计帧体前后帧头的一阶信道冲击响应,映射得到基展开系数,第二种方法针对400Hz以上情况,利用帧头循环结构,估计帧头内部信道的时变性,第三种方法针对945模式,对同一帧头进行两次一阶估计.由于信道矩阵使用基展开系数进行表示,因此LSQR均衡可以实现O(Nlog N)的复杂度.仿真结果显示,该方法提高了系统在高速时变下的性能.

关键词：信道估计均衡数字电视时域同步正交频分复用快时变

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应用于全数字锁相环的动态器件匹配与低功耗鉴相技术

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复旦学报（自然科学版） 2013年第4期52卷 526-534页

作者：刘鹏飞李巍李宁复旦大学专用集成电路与系统国家重点实验室上海201203

提出了应用于全数字锁相环的改进的动态器件匹配技术和低功耗鉴相技术.利用低功耗鉴相技术简化了传统的全数字锁相环的鉴相原理,发明出一种新型的数字鉴相器,降低了数字电路实现的复杂性,降低了功耗;同时,本文所述的应用于全数字锁相环... 详细信息

提出了应用于全数字锁相环的改进的动态器件匹配技术和低功耗鉴相技术.利用低功耗鉴相技术简化了传统的全数字锁相环的鉴相原理,发明出一种新型的数字鉴相器,降低了数字电路实现的复杂性,降低了功耗;同时,本文所述的应用于全数字锁相环的动态器件匹配技术,降低了电容的工艺偏差对锁相环输出调谐曲线的不利影响,优化了锁相环的性能.该全数字锁相环采用TSMC 0.13μm CMOS工艺进行设计,仿真结果表明,本文所述的低功耗鉴相器功能正确,可使全数字锁相环正确地锁定在2.4～5.2GHz,本文所述的基于改进算法的芯片中鉴相器部分具有传统架构鉴相器53.2%的功耗与66.5%的芯片面积.测试结果表明,动态器件匹配技术使振荡器的输出调谐曲线(本文指输出频率与DCO调制字码值的曲线关系)更加接近理想情况.

关键词：全数字锁相环数字鉴相器低功耗动态器件匹配调谐曲线优化

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