检索结果-内蒙古大学图书馆

复旦学报（自然科学版） 2015年第6期54卷 706-712,720页

作者：袁靖茹杨震刘威王健来金梅复旦大学专用集成电路与系统国家重点实验室上海201203

常规的测试时序电路最大工作频率的方法不仅受到测试设备测试能力的限制,还需要针对待测电路开发一套测试激励并逐个对待测电路进行测试,而不同的测试激励将带来测试误差.针对上述问题,提出了一种通过构建内建自测试(Build-in Self Test... 详细信息

常规的测试时序电路最大工作频率的方法不仅受到测试设备测试能力的限制,还需要针对待测电路开发一套测试激励并逐个对待测电路进行测试,而不同的测试激励将带来测试误差.针对上述问题,提出了一种通过构建内建自测试(Build-in Self Test,BIST)电路测试FPGA中时序电路关键路径延迟,从而获取时序电路最大工作频率的测试方法.该方法根据时序电路的静态时序分析结果,首先从时序电路中抽取关键路径,随后在关键路径两端构建BIST电路并为其提供测试激励.基于该测试方法,利用C++语言开发了一个软件平台实现了对时序电路抽取关键路径和构建BIST电路的过程,大大降低了测试前构建BIST电路的时间和劳动力成本.实验结果表明,与消除了由测试激励不同带来的误差的常规方法相比,本文提出的测试方法的平均误差仅为2.70%.

关键词： FPGA 时序电路最大工作频率内建自测试关键路径抽取

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一款12位5 kS/s逐次逼近型模数转换器的设计

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固体电子学研究与进展 2018年第1期38卷 75-79页

作者：王克柔洪志良复旦大学专用集成电路与系统国家重点实验室上海200120

提出了一种模拟域的前台校准技术,据此设计了一款12位精度的模数转换器(ADC)。芯片采用全定制叉指电容来实现电容阵列,并在TSMC 65nm工艺下进行了流片验证。芯片的内核面积仅为0.2 mm2,测试数据显示,在5kHz转换速率时信噪失真比(SNDR)为... 详细信息

提出了一种模拟域的前台校准技术,据此设计了一款12位精度的模数转换器(ADC)。芯片采用全定制叉指电容来实现电容阵列,并在TSMC 65nm工艺下进行了流片验证。芯片的内核面积仅为0.2 mm2,测试数据显示,在5kHz转换速率时信噪失真比(SNDR)为62dB,无杂散动态范围(SFDR)为76dB,在1.2V电源电压下功耗仅为112nW。

关键词：逐次逼近型模数转换器超低功耗设计模拟域前台校准

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MPEG专用idCT处理器的优化设计

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Journal of Semiconductors 2000年第8期21卷 810-815页

作者：陈旭昀郑金山周汀章倩苓复旦大学专用集成电路与系统国家重点实验室上海200433

二维离散余弦逆变换 ( Inverse Discrete Cosine Transform,idCT)是运动图象专家组( Moving Picture Expert Group,MPEG)视频解码器的重要模块之一 .提出了一种优化的二维idCT超大规模集成电路 ( Very Large Scale Integrated Circuit,VLSI)实现结构 .利用 idCT的矩阵乘法中固定系数的内在特点 ,采用公用表达式的方法 ,降低 idCT实现规模 ,提高了电路的速度 .采用了 0 .6μm CMOS电路工艺 ,芯片面积约为 3.5mm× 3.5mm,速度可达 1 0 0

关键词： idCT处理器运动图象专家组优化设计

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一种采用标准数字单元实现的5bit 100MS/s全数字闪烁型模数转换器

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复旦学报（自然科学版） 2016年第4期55卷 410-417,424页

作者：薛香艳周雪荣叶凡任俊彦复旦大学专用集成电路与系统国家重点实验室上海201203

设计了一种全数字实现的5bit闪烁型模数转换器,该设计的核心思想是通过差分延时链对,将输入的差分模拟信号转换为延时信号,再经过锁存器得到与相应参考电压的比较结果.该数字比较器的参考电压内置于差分延时链对,无需从外部输入.采样保... 详细信息

设计了一种全数字实现的5bit闪烁型模数转换器,该设计的核心思想是通过差分延时链对,将输入的差分模拟信号转换为延时信号,再经过锁存器得到与相应参考电压的比较结果.该数字比较器的参考电压内置于差分延时链对,无需从外部输入.采样保持电路的开关和保持电容也使用数字库中的合适器件代替.该模数转换器完全采用标准数字单元库中的单元搭建而成,与传统实现方法相比,在功耗、面积及设计复杂度上均有了较大程度的改善.电路采用TSMC 65nm工艺设计,核心面积为0.02mm2,在采样频率为100MS/s的情况下,后仿真功耗低达0.6mW,SFDR为37.89dB,ENOB为4.55bit.

关键词：闪烁型模数转换器全数字模数转换器内置参考电压

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考虑悬浮哑元的结构化随机行走电容提取算法

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复旦学报（自然科学版） 2014年第1期53卷 9-16,23页

作者：孙泽武朱恒亮曾璇复旦大学专用集成电路与系统国家重点实验室上海201203

为了解决化学机械抛光(CMP)工艺带来的芯片平整性问题,集成电路制造工艺越来越多地选择向电路版图中填充金属哑元.然而,电路中的大量金属哑元大幅增加了互连线的寄生电容值.在提取含大量哑元电路的寄生电容时,传统寄生电容提取算法的效... 详细信息

为了解决化学机械抛光(CMP)工艺带来的芯片平整性问题,集成电路制造工艺越来越多地选择向电路版图中填充金属哑元.然而,电路中的大量金属哑元大幅增加了互连线的寄生电容值.在提取含大量哑元电路的寄生电容时,传统寄生电容提取算法的效率会受到明显影响.提出了一种基于随机行走的寄生电容提取算法,利用区域分解技术,将哑元区域划分为多个子区域,通过对具有相同结构的标准子区域建立宏模型,并计算其马尔可夫转移矩阵,利用转移概率实现哑元区域内的"行走".同传统算法相比,在保证提取精度的前提下,方法具有更快的提取速度.此外,宏模型的建立可以避免对标准哑元结构的重复计算,提高计算结果的复用率.

关键词：电容提取悬浮哑元随机行走区域分解

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一种基于OFDM和比特分配技术的改善低压电力线通信性能的方法

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复旦学报（自然科学版） 2014年第1期53卷 17-23页

作者：刘轰俞晓雪闵昊复旦大学专用集成电路与系统国家重点实验室上海201203

现有电力线通信技术由于受到信道频率选择性衰减以及窄带噪声等特性的影响，限制了其更广泛的应用．通过对PLC系统的分析，提出了采用基于OFDM和比特分配技术的PLC系统方案，并在Matlab平台上建立了OFDM低压窄带（3-500kHz）电力线通信... 详细信息

现有电力线通信技术由于受到信道频率选择性衰减以及窄带噪声等特性的影响，限制了其更广泛的应用．通过对PLC系统的分析，提出了采用基于OFDM和比特分配技术的PLC系统方案，并在Matlab平台上建立了OFDM低压窄带（3-500kHz）电力线通信系统模型，完成系统仿真，并分析了方案的可行性．同时，基于此方案完成了硬件系统的设计，并在实际电力线信道环境下进行测试，实验结果表明：OFDM和比特分配技术非常适合应用在PLC系统中，可以实现高速可靠的通信．

关键词：电力线通信信道 OFDM 比特分配智能电网

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一个0.9V电源电压16位300μW音频ΣΔ调制器

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复旦学报（自然科学版） 2008年第6期47卷 763-768页

作者：苟曦李怡然陈建球许俊任俊彦复旦大学专用集成电路与系统国家重点实验室上海201203

设计了一个应用于0.9 V电源电压,精度达16 bit,功耗仅为300μW的音频ΣΔ调制器.调制器采用了前馈单环三阶结构,以降低整个调制器的功耗;并采用时钟自举电路以实现低电压下CMOS开关的良好导通.芯片采用SMIC 0.18μm一层多晶六层金属工... 详细信息

设计了一个应用于0.9 V电源电压,精度达16 bit,功耗仅为300μW的音频ΣΔ调制器.调制器采用了前馈单环三阶结构,以降低整个调制器的功耗;并采用时钟自举电路以实现低电压下CMOS开关的良好导通.芯片采用SMIC 0.18μm一层多晶六层金属工艺进行设计和仿真,芯片核心部分面积为0.7 mm×0.66 mm.后仿真结果显示该调制器在20 kHz的音频信号带宽范围内信噪比可达93 dB.

关键词： ΣΔ调制器高精度低电压低功耗

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一种适用于ECMA-368 MB-OFDM UWB系统接收机的加窗处理方法

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复旦学报（自然科学版） 2010年第2期49卷 215-220页

作者：胡子夏王伶俐童家榕复旦大学专用集成电路与系统国家重点实验室上海201203

首次提出了适用于零值填充多带正交频分复用系统(OFDM)的接收端加窗处理方法.该算法可以有效地抵抗系统中的强窄带干扰,提高OFDM系统各子载波上的信号干扰比.相对于其他的抗窄带干扰算法,该算法可以降低均衡器的复杂度,并且不需要对窄... 详细信息

首次提出了适用于零值填充多带正交频分复用系统(OFDM)的接收端加窗处理方法.该算法可以有效地抵抗系统中的强窄带干扰,提高OFDM系统各子载波上的信号干扰比.相对于其他的抗窄带干扰算法,该算法可以降低均衡器的复杂度,并且不需要对窄带干扰的频率和带宽进行预估计.在硬件实现上,加窗算法只需要在系统的接收端进行简单的加法和乘法运算,因此它很有可能成为未来工业界一种新兴的抗干扰技术.通过在不同强窄带干扰源下的系统无线数据包错误率仿真测试,验证了该算法的有效性和可行性.

关键词：窄带干扰接收端加窗算法多波段正交频分复用超宽带

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一种基于并行模拟退火的FPGA布局算法

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复旦学报（自然科学版） 2012年第6期51卷 716-721页

作者：王臻来金梅复旦大学专用集成电路与系统国家重点实验室上海201203

随着现场可编程门阵列FPGA容量的迅速增大,用户的设计编译时间也越来越长,其中以布局环节最为耗时.提出了一种基于并行模拟退火的FPGA布局算法DPSA,使用动态的交换次数更新策略.计算结果表明,在4核的实验条件下,DPSA算法比以VPR为代表... 详细信息

随着现场可编程门阵列FPGA容量的迅速增大,用户的设计编译时间也越来越长,其中以布局环节最为耗时.提出了一种基于并行模拟退火的FPGA布局算法DPSA,使用动态的交换次数更新策略.计算结果表明,在4核的实验条件下,DPSA算法比以VPR为代表的串行算法在布局速度上平均提高了2.9倍,布局质量提高了4%,并且加速性能随着CPU核心的增加具有良好的扩展性.另外,由于各线程间采用同步通信的方式,DPSA算法具有确定性的布局结果.

关键词：现场可编程门阵列布局算法并行算法马尔可夫链

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一种基于CMOS工艺的大范围可调宽带低通滤波器

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复旦学报（自然科学版） 2014年第3期53卷 387-392,402页

作者：林楠东尚清洪志良复旦大学专用集成电路与系统国家重点实验室上海201203

设计了一款适用于高速硬盘读取通道模拟前端,具有大带宽和大截止频率可调范围的低通滤波器.提出了具有高低带宽两种工作模式的滤波器架构.在高带宽和低带宽两种工作模式之间切换可以提供超过100倍的截止频率变化范围.该低通滤波器采用SM... 详细信息

设计了一款适用于高速硬盘读取通道模拟前端,具有大带宽和大截止频率可调范围的低通滤波器.提出了具有高低带宽两种工作模式的滤波器架构.在高带宽和低带宽两种工作模式之间切换可以提供超过100倍的截止频率变化范围.该低通滤波器采用SMIC 0.13μm CMOS工艺进行设计,仿真结果表明滤波器带宽为30 MHz^3.1 GHz可调,最大功耗为35 mW,信噪比为56.5 dB.

关键词：高速硬盘读取通道宽带低通滤波器带宽调节

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