检索结果-内蒙古大学图书馆

复旦学报（自然科学版） 2013年第4期52卷 479-485页

作者：毛劲松叶海江周灏王健来金梅复旦大学专用集成电路与系统国家重点实验室上海201203

针对当前FPGA芯片编程下载(配置)电路结构上的不足导致位流下载回读吞吐率较低问题,设计了一种流水线编程下载电路结构,将位流下载分两级流水线并行实施,第一级通过快速解析位流的指令集实现数据包的分拆,第二级将解析出的数据包送达内... 详细信息

针对当前FPGA芯片编程下载(配置)电路结构上的不足导致位流下载回读吞吐率较低问题,设计了一种流水线编程下载电路结构,将位流下载分两级流水线并行实施,第一级通过快速解析位流的指令集实现数据包的分拆,第二级将解析出的数据包送达内部编程点相应的字线与位线.采用与电路结构兼容的32位并行CRC32技术校验下载位流,以增强位流下载可靠性,并采用帧ECC电路对回读位流进行单比特纠错与多比特检错(SECDED).验证结果表明,该设计在内部振荡器频率为150MHz的情况下外部配置端口的最高吞吐率为3 680Mbps,在内部振荡器频率为200MHz的情况下最高吞吐率为4 896Mbps.

关键词：现场可编程逻辑门阵列编程下载吞吐率 CRC32 ECC

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TDS-OFDM时变信道估计和均衡的BEM-LSQR方法

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复旦学报（自然科学版） 2013年第3期52卷 328-333页

作者：王亦之陈赟曾晓洋复旦大学专用集成电路与系统国家重点实验室上海201203

中国地面高清数字电视(DTMB)在高速移动环境下的应用日益广泛.利用其多载波模式下的时域同步正交频分复用(TDS-OFDM)帧结构,提出三种利用基展开模型(BEM)的针对不同场合的时变信道估计方法,并利用正交分解最小二乘(LSQR)对帧体进行均衡... 详细信息

中国地面高清数字电视(DTMB)在高速移动环境下的应用日益广泛.利用其多载波模式下的时域同步正交频分复用(TDS-OFDM)帧结构,提出三种利用基展开模型(BEM)的针对不同场合的时变信道估计方法,并利用正交分解最小二乘(LSQR)对帧体进行均衡.第一种信道估计方法针对400Hz及以下多普勒频移,分别估计帧体前后帧头的一阶信道冲击响应,映射得到基展开系数,第二种方法针对400Hz以上情况,利用帧头循环结构,估计帧头内部信道的时变性,第三种方法针对945模式,对同一帧头进行两次一阶估计.由于信道矩阵使用基展开系数进行表示,因此LSQR均衡可以实现O(Nlog N)的复杂度.仿真结果显示,该方法提高了系统在高速时变下的性能.

关键词：信道估计均衡数字电视时域同步正交频分复用快时变

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基于多核架构适用于LTE标准的FFT算法研究与实现

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复旦学报（自然科学版） 2013年第3期52卷 285-291,296页

作者：徐虎雄盛嘉奕陈赟虞志益复旦大学专用集成电路与系统国家重点实验室上海201203

基于多核架构提出了一种适用于长期演进技术(LTE)下行链路128～2048/1536点快速傅里叶变换(FFT)计算的算法,并进行了仿真.利用多核结构将FFT算法进行并行划分,采用流水线并行和数据并行的结构,减少运行时间.同时将该算法基于一块使用TSM... 详细信息

基于多核架构提出了一种适用于长期演进技术(LTE)下行链路128～2048/1536点快速傅里叶变换(FFT)计算的算法,并进行了仿真.利用多核结构将FFT算法进行并行划分,采用流水线并行和数据并行的结构,减少运行时间.同时将该算法基于一块使用TSMC 65nm工艺制成的多核芯片上实现,在750MHz的工作频率下,计算128～2048/1536点FFT的芯片实测功耗为282～366mW,能量效率为每点35.4～84.33nJ.与其他设计相比,运行速度最多能提高近6倍,计算大点数FFT时,能量效率可提高约20%.

关键词：多核架构长期演进技术快速傅里叶变换

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应用于全数字锁相环的动态器件匹配与低功耗鉴相技术

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复旦学报（自然科学版） 2013年第4期52卷 526-534页

作者：刘鹏飞李巍李宁复旦大学专用集成电路与系统国家重点实验室上海201203

提出了应用于全数字锁相环的改进的动态器件匹配技术和低功耗鉴相技术.利用低功耗鉴相技术简化了传统的全数字锁相环的鉴相原理,发明出一种新型的数字鉴相器,降低了数字电路实现的复杂性,降低了功耗;同时,本文所述的应用于全数字锁相环... 详细信息

提出了应用于全数字锁相环的改进的动态器件匹配技术和低功耗鉴相技术.利用低功耗鉴相技术简化了传统的全数字锁相环的鉴相原理,发明出一种新型的数字鉴相器,降低了数字电路实现的复杂性,降低了功耗;同时,本文所述的应用于全数字锁相环的动态器件匹配技术,降低了电容的工艺偏差对锁相环输出调谐曲线的不利影响,优化了锁相环的性能.该全数字锁相环采用TSMC 0.13μm CMOS工艺进行设计,仿真结果表明,本文所述的低功耗鉴相器功能正确,可使全数字锁相环正确地锁定在2.4～5.2GHz,本文所述的基于改进算法的芯片中鉴相器部分具有传统架构鉴相器53.2%的功耗与66.5%的芯片面积.测试结果表明,动态器件匹配技术使振荡器的输出调谐曲线(本文指输出频率与DCO调制字码值的曲线关系)更加接近理想情况.

关键词：全数字锁相环数字鉴相器低功耗动态器件匹配调谐曲线优化

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一种用于双成像光刻中的版图分解算法

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复旦学报（自然科学版） 2013年第1期52卷 129-138页

作者：魏晗一陆伟成复旦大学专用集成电路与系统国家重点实验室上海201203

双成像光刻技术是在集成电路制造工艺不断缩小时解决光刻后图形失真问题和提高准确度的最有效的方案之一.在双成像光刻中,需要进行版图分解,将版图中多边形分解为更简单的图形的集合.现有的多边形分解算法不适合应用于双成像光刻,会产... 详细信息

双成像光刻技术是在集成电路制造工艺不断缩小时解决光刻后图形失真问题和提高准确度的最有效的方案之一.在双成像光刻中,需要进行版图分解,将版图中多边形分解为更简单的图形的集合.现有的多边形分解算法不适合应用于双成像光刻,会产生工艺无法接受的薄片,覆盖误差会导致图形断开,与双成像光刻中的版图分解的目标也不同.提出了一种新的版图分解算法,通过引入交叠,消除薄片的产生,同时解决由于覆盖误差引起的图形断开问题;减少分解后的矩形数目,从而减少双成像光刻中颜色分配后的冲突总数,适合用于双成像光刻技术.实验说明该算法有效.

关键词：双成像光刻技术版图分解算法引入交叠

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互连线高效时域多步积分模型降阶算法

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复旦学报（自然科学版） 2013年第3期52卷 339-346页

作者：郭倞杨帆曾璇复旦大学专用集成电路与系统国家重点实验室上海201203

为了进一步提高现有互连电路模型降阶算法的精度和效率,提出一种基于时域多步积分的互连线模型降阶算法.首先对原始电路的时域方程进行多步积分得到关于状态变量的二阶递推关系,然后通过二次Arnoldi方法得到投影矩阵,再通过投影矩阵对... 详细信息

为了进一步提高现有互连电路模型降阶算法的精度和效率,提出一种基于时域多步积分的互连线模型降阶算法.首先对原始电路的时域方程进行多步积分得到关于状态变量的二阶递推关系,然后通过二次Arnoldi方法得到投影矩阵,再通过投影矩阵对原始时域方程进行投影得到降阶系统.该算法可以保证时域积分后降阶系统和原始系统的状态变量在离散时间点的匹配,保证时域降阶精度,同时继承了已有算法所具有的数值稳定性及降阶系统的无源性.该算法不仅比现有的时域模型降阶算法复杂度低和比现有的频域模型降阶算法精度高,而且与时域单步积分的模型降阶算法相比,可以在保证与其计算复杂度相当的基础上,达到更高的精度.

关键词：模型降阶时域多步积分法

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基于数字延时锁相环的FPGA IO延时管理电路

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复旦学报（自然科学版） 2013年第4期52卷 497-504页

作者：王鹏翔周灏来金梅复旦大学专用集成电路与系统国家重点实验室上海201203

本文提出了一种基于过采样量化器和换挡(Gear-Shift)控制机制的新颖的数字延时锁相环(DDLL),可以嵌入于FPGA芯片IO单元的延时管理系统,实现了IO单元数据通路延时的精确校正,分辨率达到78ps,可调节范围达4ns,满足FPGA芯片对高速串行接口... 详细信息

本文提出了一种基于过采样量化器和换挡(Gear-Shift)控制机制的新颖的数字延时锁相环(DDLL),可以嵌入于FPGA芯片IO单元的延时管理系统,实现了IO单元数据通路延时的精确校正,分辨率达到78ps,可调节范围达4ns,满足FPGA芯片对高速串行接口协议复杂时序的兼容.DDLL使用独具特色的过采样量化器,仅使用1bit时间数字转换器(TDC)达到了98dB SNR,等效理论分辨率达16位,并引入了全新的Gear-Shift控制机制,对误差信息合理的加权实现快速精确的锁入,结合2阶巴特沃斯衰减的数字环路滤波器,实现全数字环路控制,较传统模拟延时锁相环,节省了芯片面积和功耗,同时对数字电路所产生的衬底噪声具有更好耐受.DDLL采用65nm数字工艺,嵌入复旦大学自主研发的FPGA芯片,经过后仿验证,锁定时间小于50cycles.

关键词：现场可编程门阵列过采样量化 Gear-Shift机制延时锁相环 IO延时管理

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一种新型高精度宽电压范围的CMOS温度传感器

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固体电子学研究与进展 2013年第2期33卷 175-178页

作者：陈刚解玉凤林殷茵复旦大学专用集成电路与系统国家重点实验室上海201203

介绍了一种用于环境温度监测的新型高精度宽电压范围的CMOS温度传感器,采用0.13μm标准CMOS工艺的厚氧器件实现,芯片面积为37μm×41μm。该温度传感器在-20～60°C的温度范围内,采用两点校正方法之后,温度误差为-0.2°C/0.... 详细信息

介绍了一种用于环境温度监测的新型高精度宽电压范围的CMOS温度传感器,采用0.13μm标准CMOS工艺的厚氧器件实现,芯片面积为37μm×41μm。该温度传感器在-20～60°C的温度范围内,采用两点校正方法之后,温度误差为-0.2°C/0.5°C。该温度传感器可以在1.8～3.6V的电源电压范围内安全可靠地工作,并且具有较高的电源抑制比。测试结果表明,其输出电压斜率为3.9mV/°C,1.8V下功耗为1.3μW。

关键词：互补型金属氧化物半导体温度传感器亚阈值区低功耗宽电压范围电源抑制比

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一种高效的模拟波形数据压缩方法

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复旦学报（自然科学版） 2013年第4期52卷 486-491页

作者：刘毅杨帆曾璇复旦大学专用集成电路与系统国家重点实验室上海201203

随着集成电路规模的增加,电路仿真的波形数据量也急剧膨胀.为了降低存储量,提出了一种高效的模拟波形数据压缩方法.该压缩方法是流压缩方法,采用预测、量化、编码等技术,所需的数据缓冲存储量很小,可在电路仿真时对仿真波形进行实时压... 详细信息

随着集成电路规模的增加,电路仿真的波形数据量也急剧膨胀.为了降低存储量,提出了一种高效的模拟波形数据压缩方法.该压缩方法是流压缩方法,采用预测、量化、编码等技术,所需的数据缓冲存储量很小,可在电路仿真时对仿真波形进行实时压缩和输出.在保持数据精度的同时,该方法可以达到很高的压缩比.该方法计算复杂度低,可以处理大数据量的波形文件,是一种非常实用的压缩方法.实际电路的仿真波形压缩测试结果表明,当波形误差在0.1%左右时,压缩文件大小仅为原文件的10%左右,极大地降低了数据存储量.

关键词：集成电路仿真波形压缩方法

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先进逻辑工艺下SRAM漏电流测试

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复旦学报（自然科学版） 2013年第4期52卷 535-540,546页

作者：陈浩董庆马亚楠林殷茵复旦大学专用集成电路与系统国家重点实验室上海201203

对于65nm及以下的先进逻辑工艺,SRAM的漏电流功耗占据了保持状态下功耗的一半以上,成为降低功耗的主要瓶颈之一.精确测量漏电流成为优化工艺从而降低功耗的先决条件.在保持SRAM原有版图环境不变的情况下,通过对SRAM施加不同激励,将栅漏... 详细信息

对于65nm及以下的先进逻辑工艺,SRAM的漏电流功耗占据了保持状态下功耗的一半以上,成为降低功耗的主要瓶颈之一.精确测量漏电流成为优化工艺从而降低功耗的先决条件.在保持SRAM原有版图环境不变的情况下,通过对SRAM施加不同激励,将栅漏电流、结漏电流和衬底漏电流这3种漏电流有效地区分出来.通过大量的测试,得到在不同温度下SRAM漏电流的相应数据结果用以分析,并对漏电流在整片晶圆内的系统波动和局部随机波动进行了讨论.

关键词：漏电流 SRAM 测试方法四端结构随机波动

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