检索结果-内蒙古大学图书馆

计算机工程与科学 2020年第9期42卷 1529-1537页

作者：王丽郭振华曹芳高开赵雅倩赵坤浪潮电子信息产业股份有限公司高效能服务器与存储技术国家重点实验室山东济南250000 广东浪潮大数据研究有限公司广东广州510000

随着训练数据规模的增大以及训练模型的日趋复杂,深度神经网络的训练成本越来越高,对计算平台提出了更高的算力需求,模型训练并行化成为增强其应用时效性的迫切需求。近年来基于分布式训练的AI加速器(如FPGA、TPU、AI芯片等)层出不穷,... 详细信息

随着训练数据规模的增大以及训练模型的日趋复杂,深度神经网络的训练成本越来越高,对计算平台提出了更高的算力需求,模型训练并行化成为增强其应用时效性的迫切需求。近年来基于分布式训练的AI加速器(如FPGA、TPU、AI芯片等)层出不穷,为深度神经网络并行训练提供了硬件基础。为了充分利用各种硬件资源,研究人员需要在集合了多种不同算力、不同硬件架构AI加速器的计算平台上进行神经网络的模型并行训练,因此,如何高效利用各种AI加速器计算资源,并实现训练任务在多种加速器上的负载均衡,一直是研究人员关心的热点问题。提出了一种面向模型并行训练的模型拆分策略自动生成方法,该方法能够基于静态的网络模型自动生成模型拆分策略,实现网络层在不同AI加速器上的任务分配。基于该方法自动生成的模型分配策略,能够高效利用单个计算平台上的所有计算资源,并保证模型训练任务在各设备之间的负载均衡,与目前使用的人工拆分策略相比,具有更高的时效性,节省拆分策略生成时间100倍以上,且降低了由于人为因素带来的不确定性。

关键词：模型并行模型训练模型拆分负载均衡

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面向混合异构架构的模型并行训练优化方法

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计算机工程与科学 2021年第1期43卷 42-48页

作者：高开郭振华陈永芳王丽赵雅倩赵坤浪潮电子信息产业股份有限公司高效能服务器与存储技术国家重点实验室山东济南250000 广东浪潮大数据研究有限公司广东广州510000

随着混合异构平台的发展,出现了类型不一的加速设备,如何在混合异构平台中充分利用这些不同类型的设备,以及如何在多个计算设备之间部署深度学习模型,而且训练大型和复杂模型的重要性不断提高。数据并行(DP)是应用最广泛的并行化策略,... 详细信息

随着混合异构平台的发展,出现了类型不一的加速设备,如何在混合异构平台中充分利用这些不同类型的设备,以及如何在多个计算设备之间部署深度学习模型,而且训练大型和复杂模型的重要性不断提高。数据并行(DP)是应用最广泛的并行化策略,但是如果数据并行训练中的设备数量不断增加,设备之间的通信开销就会成为瓶颈。此外,每个步骤因设备性能差异处理的批总量不同会导致精度损失,即需要更长的训练周期以收敛到期望的精度。这些因素会影响整体训练时间,并且会影响某些设备的运行效率。除了数据并行(DP),每个训练步骤都可以通过模型并行(MP)来加速。提出了一种适合混合异构平台的模型并行训练优化算法。首先,为解决混合异构平台中设备性能分布不均问题,提出了层级并行和通道并行混合的模型并行划分策略,同时通过合并一些性能偏低的设备来减少流水线的长度和缓解通信压力。然后为了优化设备间的流水效果,通过分析流水线建立时间占比和设备性能利用率对整体训练时间的影响,提出了一种可以使两者达到均衡状态的微批次划分方法。实验表明,通过本文方法优化之后的模型并行流水训练算法比传统的模型并行算法具有更好的加速比,在单一类型设备的异构平台上的训练性能加速比提升4%左右,在混合异构平台的训练性能加速比要比没有使用优化方法之前提升7%左右。

关键词：混合异构模型并行微批次设备差异

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一种支持多种访存技术的CBEA片上多核MPI并行编程模型

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计算机学报 2008年第11期31卷 1965-1974页

作者：冯国富董小社胡冰王旭昊王恩东西安交通大学计算机科学与技术系西安710049 高效能服务器和存储技术国家重点实验室济南250013 浪潮电子信息产业股份有限公司北京100085

现有的CBEA（Cell Broadband Engine Architecture）编程模型多侧重于支持类似于流处理的“批量访存”（Bulk Data Transfer）应用,传统非规则访存应用性能较低.文中基于Cell架构提出了一种同时支持“批量访存”与非规则访存应用的MPI... 详细信息

现有的CBEA（Cell Broadband Engine Architecture）编程模型多侧重于支持类似于流处理的“批量访存”（Bulk Data Transfer）应用,传统非规则访存应用性能较低.文中基于Cell架构提出了一种同时支持“批量访存”与非规则访存应用的MPI并行编程模型,将通信分解在PPE（PowerPC Processing Element）上,拓宽模型的适用范围;在统一访存接口下,通过运行时访存剖分信息指导选择和优化访存以提高计算效率.实验结果表明,文中提出的编程模型支持多种访存模式并具有很好的并行加速比,可获得较同类相关技术30%-50%左右的性能提升.

关键词：异构多核 CBE架构并行编程模型 MPI 访存技术剖分优化

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BUCK电路设计的系统级仿真调试方法

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电子器件 2018年第4期41卷 965-969页

作者：宋晓锋管海兵李德恒上海市可扩展计算与系统重点实验室(上海交通大学) 上海200240 高效能服务器和存储技术国家重点实验室(浪潮电子信息产业股份有限公司) 济南250101

为借助仿真加快BUCK电路调试进度。对BUCK电路进行了建模仿真,根据仿真与量测的比对结果及电流反馈理论,对电容及电感等效模型进行了修正,修正后的BUCK电路仿真结果可以实现与量测结果的良好匹配。根据环路补偿理论,对TypeⅡ环路补偿设... 详细信息

为借助仿真加快BUCK电路调试进度。对BUCK电路进行了建模仿真,根据仿真与量测的比对结果及电流反馈理论,对电容及电感等效模型进行了修正,修正后的BUCK电路仿真结果可以实现与量测结果的良好匹配。根据环路补偿理论,对TypeⅡ环路补偿设计进行参数扫描仿真分析,找出了Transient设计最优解以满足BUCK电路设计要求。通过比对优化后的仿真与量测结果,其Peak-Peak电压差值为7 m V,验证了此仿真调试方法的正确性和有效性。

关键词： BUCK 仿真环路补偿系统调试

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可重构高速数据加密系统设计和实现

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电子测量技术 2021年第19期44卷 8-15页

作者：王凯刘凯李拓符云越刘唐王骞山东海量信息技术研究院济南250098 浪潮电子信息产业股份有限公司高效能服务器和存储技术国家重点实验室济南250101 山东浪潮人工智能研究院有限公司济南250101

为解决SM4传统加解密方式存在的速度慢、效率低、占用CPU计算资源的问题,提出了一种可重构高速数据加密系统。该系统基于Xilinx Virtex UltraScale VU9p FPGA,利用PCIe热插拔特性,可快速应用于办公主机或服务器,通过PCIe高速接口实现数... 详细信息

为解决SM4传统加解密方式存在的速度慢、效率低、占用CPU计算资源的问题,提出了一种可重构高速数据加密系统。该系统基于Xilinx Virtex UltraScale VU9p FPGA,利用PCIe热插拔特性,可快速应用于办公主机或服务器,通过PCIe高速接口实现数据的快速传输,在FPGA内实现并行可调度SM4算法逻辑,设计有专用DMA模块,实现旁路主机CPU传输明文密文,减少主机端资源占用;采用FPGA实现的加解密系统具备可重构性,大大降低了算法迭代的硬件成本。系统分析测试和实验结果表明,该系统实现了数据的高速可靠传输与加密,总线速率达到8 GT/s,能有效满足大容量数据快速加解密的需求;采用并行可调度流水线加解密,较CPU实现方式,加解密速率提升约25.78倍。

关键词： PCIe高速总线 SM4加解密直接存储器访问高速数据传输现场可编程门阵列(FPGA)

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基于SystemVerilog的图像采集压缩卡芯片验证平台设计

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电子测量技术 2021年第20期44卷 29-36页

作者：王凯王骞符云越李拓刘凯山东海量信息技术研究院济南250098 浪潮电子信息产业股份有限公司高效能服务器和存储技术国家重点实验室济南250101 山东浪潮人工智能研究院有限公司济南250101

验证平台对视频采集压缩卡芯片的开发设计有重要作用。针对传统的验证平台在代码覆盖率以及测试效率方面存在的不足,设计了一款基于SystemVerilog搭建的验证平台,该验证平台采用面向对象程序语言设计,其中,PCIe host(RP)端采用Xilinx I... 详细信息

验证平台对视频采集压缩卡芯片的开发设计有重要作用。针对传统的验证平台在代码覆盖率以及测试效率方面存在的不足,设计了一款基于SystemVerilog搭建的验证平台,该验证平台采用面向对象程序语言设计,其中,PCIe host(RP)端采用Xilinx IP建模链路层和物理层,保证了PCIe总线环境与真实主机板卡环境相同;外部验证环境采用SystemVerilog分层设计的方法,并采用类思想进行上层验证环境设计,使较多验证组件能够移植至同一接口协议的不同类SoC;此外,在自动化验证阶段,通过仿真报告自动判断case状态,调整随机基准以及在覆盖率报告中追踪未覆盖模块路径,极大地改善了代码的边角覆盖情况,加速了回归收敛。从采集压缩仿真过程、验证自动化以及覆盖率3个方面对该验证平台进行了分析,结果表明,该验证平台可快速完成相似设计的验证模组横向移植,提高相似功能芯片的验证可靠性,节省人力,加快仿真进度,加速覆盖率收敛,缩短验证周期,增加流片成功率。

关键词： SystemVerilog 功能验证自动化验证覆盖率收敛

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Buck芯片缓冲电路设计的仿真分析与应用

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电子技术应用 2021年第10期47卷 113-117,123页

作者：叶丰华刘昊康磊蔡文波浪潮电子信息产业股份有限公司浪潮高效能服务器和存储技术国家重点实验室北京100086

Buck型变换器的开关点是外部调优的主要对象,随着开关频率的提高和负载电流的增大,芯片内的寄生电感对开关电压波形的影响越来越大,外部缓冲电路作为调整开关波形的工具起到关键的作用,仅仅依靠经验来设计外部缓冲电路已经无法满足设计... 详细信息

Buck型变换器的开关点是外部调优的主要对象,随着开关频率的提高和负载电流的增大,芯片内的寄生电感对开关电压波形的影响越来越大,外部缓冲电路作为调整开关波形的工具起到关键的作用,仅仅依靠经验来设计外部缓冲电路已经无法满足设计要求。通过对缓冲电路的工作原理进行分析,结合仿真结果和工程实践,分析缓冲电路的稳压性能和效率损失,可以为外围缓冲电路的设计提供一种量化分析方法。

关键词： Buck型变换器仿真缓冲电路效率

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云计算计费模型研究

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信息技术与标准化 2014年第3期 32-35,38页

作者：于辉刘正伟刘俊朋郭锋高效能服务器和存储技术国家重点实验室浪潮电子信息产业股份有限公司

分析并提出了一种基于用户业务相关的灵活定价策略和用户资源使用行为及对资源评价反馈的计费模型:首先,基于设定的业务类别资源定价策略关联模块,获取针对特定业务类别的资源单价策略,同时通过对云计算系统中用户的资源使用行为的分析... 详细信息

分析并提出了一种基于用户业务相关的灵活定价策略和用户资源使用行为及对资源评价反馈的计费模型:首先,基于设定的业务类别资源定价策略关联模块,获取针对特定业务类别的资源单价策略,同时通过对云计算系统中用户的资源使用行为的分析,获得用户的资源使用行为影响因子;并依据SLA(服务等级协议)对资源提供者进行评价得到服务满意度,基于用户行为影响因子和服务满意度对计费结果进行调整。模型的实际应用表明,其具有良好的应用效果。

关键词：云计费资源定价用户资源使用行为服务等级协议

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Allegro软件基于Form格式的框架开发

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单片机与嵌入式系统应用 2021年第2期21卷 11-15,19页

作者：付深圳刘涛张柱高效能服务器和存储技术国家重点实验室济南250014 浪潮电子信息产业股份有限公司

在EDA设计领域,Cadence作为最大电子设计自动化供应商,旗下的Allegro软件是业界知名的PCB设计软件,提供了丰富的二次开发接口和完善的开发语言。本文主要是基于Allegro软件的Skill语言二次开发,开发带有Form格式的编程框架,工程师使用... 详细信息

在EDA设计领域,Cadence作为最大电子设计自动化供应商,旗下的Allegro软件是业界知名的PCB设计软件,提供了丰富的二次开发接口和完善的开发语言。本文主要是基于Allegro软件的Skill语言二次开发,开发带有Form格式的编程框架,工程师使用该框架开发的工具能够通过UI界面实现人机交互,另外,工程师在改变Allegro内部Database时,能够对操作进行回滚、取消、完成等,方便工程师快速操作。该框架为二次开发者提供一种高效的编程思想,提高了开发效率和质量。

关键词： Skill语言 PCB设计 EDA设计 Allegro

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云计算下协作标注系统中用户标注机制探讨

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信息技术与标准化 2015年第12期 26-29,34页

作者：于辉刘俊朋李新虎高效能服务器和存储技术国家重点实验室浪潮电子信息产业股份有限公司

从协作标注系统的用户标注行为出发,提出综合信息值模型和优先连接模型,并建立一个新的用户标注机制模型,同时验证用户标注机制模型的合理性,为进一步开展相关科研工作提供一个新的角度。

关键词：云计算协作标注系统用户标注机制模型 Agent仿真

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