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  • 28 篇 中文
检索条件"机构=解放军电子工程学院工程实验中心"
28 条 记 录,以下是1-10 订阅
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雷达射频前端的仿真设计
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航天电子对抗 2008年 第3期24卷 62-64页
作者: 周志增 李东生 李逸雷 解放军电子工程学院工程实验中心 安徽合肥230037
采用自顶向下的设计方法,设计了工作于S波段的带宽为100MHz的雷达接收前端。使用Agilent公司的ADS微波设计软件对系统性能进行了仿真论证。分别设计了低噪声放大器、混频器、中频放大器模块,仿真结果均达到要求。前端仿真结果:增益大于7... 详细信息
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0.35um CMOS工艺GPS接收机前端低噪声放大器的设计
0.35um CMOS工艺GPS接收机前端低噪声放大器的设计
收藏 引用
2005年“数字安徽”博士科技论坛
作者: 王昌林 李东生 解放军电子工程学院工程实验中心
利用TSMC 0.35um CMOS工艺参数,设计了可应用于GPS接收机的低噪声放大器(LNA),电路采用单端共源共栅结构,用SmartSpice对电路进行分析优化,仿真结果表明,噪声系数为1.43dB,增益高于20dB。
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基于IP核的可编程系统芯片(SOPC)设计方法
基于IP核的可编程系统芯片(SOPC)设计方法
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2005年“数字安徽”博士科技论坛
作者: 马涛 李东生 解放军电子工程学院工程实验中心
可编程片上系统设计是一个崭新的嵌入式系统设计技术。本文在阐述SOPC基本特征与IP核概念的基础上,介绍了Altera公司的Nios软核处理器并给出了利用QuartusII中集成的SOPCBuilder开发工具进行SOPC设计的方法及实例。
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一种数控振荡器(NCO)的FPGA实现新方法
一种数控振荡器(NCO)的FPGA实现新方法
收藏 引用
2005年“数字安徽”博士科技论坛
作者: 马涛 李东生 解放军电子工程学院工程实验中心
本文介绍了采用系统工具DSP Builder实现数字下变频器中数控振荡器的设计方法,并在Stratix(EP1S25F780C5)的FPGA上予以实现,系统的最高时钟频率可达到233.54MHz,输出波形满足设计要求。
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单芯片可重构数字接收机的研究
单芯片可重构数字接收机的研究
收藏 引用
2005年“数字安徽”博士科技论坛
作者: 马涛 李东生 解放军电子工程学院工程实验中心
本文从系统的小型化和可重构性出发,介绍了可编程系统芯片(SOPC)技术。给出了单芯片可重构数字接收机的实现方案,利用系统工具DSP Builder给出了QPSK解调功能模块的FPGA仿真与硬件验证。
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System View中嵌入自定义控件的实现
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系统仿真学报 2003年 第9期15卷 1222-1223页
作者: 王俊林 李东生 王勇 解放军电子工程学院电子技术实验中心 合肥230037 合肥工业大学 合肥230009
工程设计中,采用先进的仿真工具对系统进行建模和仿真,逐步成为一个必不可少的环节。该文在分析SystemView特点和控件的基础上,介绍了在Windows 98 操作环境下采用Visual C++ 6.0 的动态链接库设计SystemView仿真工具中自定义控件的方... 详细信息
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一种数控振荡器(NCO)的FPGA实现新方法
一种数控振荡器(NCO)的FPGA实现新方法
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2005年“数字安徽”博士科技论坛
作者: 马涛 李东生 解放军电子工程学院工程实验中心 合肥 230037
本文介绍了采用系统工具DSP Builder实现数字下变频器中数控振荡器的设计方法,并在Stratix(EPIS25F780C5)的FPGA上予以实现,系统的最高时钟频率可达到233.54MHz,输出波形满足设计要求.
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单芯片可重构数字接收机的研究
单芯片可重构数字接收机的研究
收藏 引用
2005年“数字安徽”博士科技论坛
作者: 马涛 李东生 解放军电子工程学院工程实验中心 合肥 230037
本文从系统的小型化和可重构性出发,介绍了可编程系统芯片(SOPC)技术.给出了单芯片可重构数字接收机的实现方案,利用系统工具DSP Builder给出了QPSK解调功能模块的FPGA仿真与硬件验证.
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基于IP核的可编程系统芯片(SOPC)设计方法
基于IP核的可编程系统芯片(SOPC)设计方法
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2005年“数字安徽”博士科技论坛
作者: 马涛 李东生 解放军电子工程学院工程实验中心 合肥 230037
可编程片上系统设计是一个崭新的嵌入式系统设计技术.本文在阐述SOPC基本特征与IP核概念的基础上,介绍了Altera公司的Nios软核处理器并给出了利用Quartus Ⅱ中集成的SOPCBuilder开发工具进行SOPC设计的方法及实例.
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0.35um CMOS工艺GPS接收机前端低噪声放大器的设计
0.35um CMOS工艺GPS接收机前端低噪声放大器的设计
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2005年“数字安徽”博士科技论坛
作者: 王昌林 李东生 解放军电子工程学院工程实验中心 合肥 230037
利用TSMC 0.35um CMOS工艺参数,设计了可应用于GPS接收机的低噪声放大器(LNA),电路采用单端共源共栅结构,用SmartSpice对电路进行分析优化,仿真结果表明,噪声系数为1.43dB,增益高于20dB.
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