检索结果-内蒙古大学图书馆

计算机工程与应用 2011年第31期47卷 234-237页

作者：周士红吴立锋关永杜银瑜潘巍首都师范大学高可靠嵌入式系统技术北京市工程研究中心北京100048

在DC-DC电源中,滤波网络中铝电解电容的劣化是影响电源寿命的主要因素,因此可以通过监测电容的劣化来评估DC-DC的健康状况。基于前期对电容的主要劣化模式及其对DC-DC影响的研究工作建立了电容劣化对DC-DC寿命影响仿真系统。该系统以Lab... 详细信息

在DC-DC电源中,滤波网络中铝电解电容的劣化是影响电源寿命的主要因素,因此可以通过监测电容的劣化来评估DC-DC的健康状况。基于前期对电容的主要劣化模式及其对DC-DC影响的研究工作建立了电容劣化对DC-DC寿命影响仿真系统。该系统以LabView为主设计完成,通过劣化注入的方式模拟电容劣化。系统测试结果:电容劣化引起DC-DC输出纹波电压变大,DC-DC寿命缩短,这与理论分析一致。该系统可以仿真电容劣化的过程并可研究电容劣化对DC-DC寿命的影响。

关键词： DC-DC电源仿真系统 LabView 劣化注入纹波电压

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基于SOPC技术的高速图像采集控制系统的设计与研究

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传感技术学报 2011年第6期24卷 864-869页

作者：尚媛园杨新华徐达维赵晓旭牛慧卓首都师范大学信息工程学院北京100048 高可靠嵌入式系统技术北京市工程研究中心北京100048

针对高速图像采集控制系统中带宽不足的问题,应用SOPC(System on a Programmable Chip)技术在Avalon总线中嵌入自定义外设完成图像采集、图像数据压缩和图像存储,大大提高了系统的成像速度。首先,通过在图像采集端对数据进行流水线压缩... 详细信息

针对高速图像采集控制系统中带宽不足的问题,应用SOPC(System on a Programmable Chip)技术在Avalon总线中嵌入自定义外设完成图像采集、图像数据压缩和图像存储,大大提高了系统的成像速度。首先,通过在图像采集端对数据进行流水线压缩编码的方法,将数据量压缩为原来的四分之三。然后,基于VHDL设计并实现DMA控制器,该自定义DMA控制器可以把图像数据直接存入SDRAM中的两块缓存区,省掉了传统数据采集系统中必须使用FIFO对数据进行缓存的环节,减轻了CPU的数据传输任务。另外,通过将系统图像采集模块和数据传输模块的并行化处理,提高了成像系统工作的效率。最后,在2k×2k高速CMOS成像系统上进行了实现,通过速度测试和成像测试验证了该图像采集控制系统设计的可行性与灵活性。

关键词：图像采集 SOPC DMA控制器并行处理高速

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基于UM-BUS总线的可重构缓存机制的研究与设计

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计算机工程与设计 2014年第4期35卷 1433-1438,1446页

作者：杨小林张伟功首都师范大学北京市高可靠嵌入式系统技术工程研究中心北京100048

为提高动态可重构高速串行总线UM-BUS的带宽利用率,通过分析UM-BUS总线数据访问和传送的特点,提出了一种有效可行的两级缓存管理算法,并采用该算法设计了一种静态可重构的数据高速缓存机制。该缓存机制采用了驱动级缓存以及可重构缓存... 详细信息

为提高动态可重构高速串行总线UM-BUS的带宽利用率,通过分析UM-BUS总线数据访问和传送的特点,提出了一种有效可行的两级缓存管理算法,并采用该算法设计了一种静态可重构的数据高速缓存机制。该缓存机制采用了驱动级缓存以及可重构缓存的技术,在UM-BUS总线控制器的驱动程序中得到实现。实验结果表明,该缓存机制能长时间的安全稳定地运行,且有效地提高总线带宽利用率,验证了该缓存机制的正确性和有效性。

关键词：可重构高速串行总线高速缓存替换算法预取回写

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新型总线中并行CRC算法的设计与实现

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计算机工程与设计 2013年第1期34卷 131-135页

作者：杜瑞张伟功邓哲朱晓燕首都师范大学北京市高可靠嵌入式系统技术工程研究中心北京100048

为了对动态可重构高速串行总线UM-BUS进行差错控制,提出了一种用于新型总线数据校验的四通道并行CRC算法。根据UM-BUS的多通道并发通信方式和通道动态组织特点,采用四体FIFO进行数据缓冲存储,并设计了满足总线特点的四通道并行CRC编解... 详细信息

为了对动态可重构高速串行总线UM-BUS进行差错控制,提出了一种用于新型总线数据校验的四通道并行CRC算法。根据UM-BUS的多通道并发通信方式和通道动态组织特点,采用四体FIFO进行数据缓冲存储,并设计了满足总线特点的四通道并行CRC编解码器。在此基础上,给出了它的FPGA实现方案和仿真结果。该并行CRC编解码器,可实时计算总线通信数据的CRC校验码,已成功的应用于动态可重构高速串行总线系统中,实现对突发错误的实时检测,通信速率达到100Mbps/通道。

关键词：循环冗余校验码(CRC) 高可靠嵌入式系统故障容错动态重构高速串行总线

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动态可重构总线数据传输管理方法设计与实现

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计算机工程 2013年第1期39卷 264-269页

作者：邓哲张伟功朱晓燕杜瑞首都师范大学北京市高可靠嵌入式系统技术工程研究中心北京100048

为实现总线多通道数据并发高速传输与容错,解决故障状态下的总线数据动态重构问题,设计一种动态可重构总线数据传输管理方法。采用四体先入先出队列(FIFO)进行数据缓冲存储,利用通道故障状态表,通过4×32矩阵开关数据,传输管理阵列... 详细信息

为实现总线多通道数据并发高速传输与容错,解决故障状态下的总线数据动态重构问题,设计一种动态可重构总线数据传输管理方法。采用四体先入先出队列(FIFO)进行数据缓冲存储,利用通道故障状态表,通过4×32矩阵开关数据,传输管理阵列组织与4个FIFO缓冲区及所有有效通道间的数据传输。在8通道系统中的实验结果表明,最高通信速率可达到800 Mb/s,能对7个通道故障进行动态容错。

关键词：高速串行总线故障容错动态重构并发传输矩阵开关

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D2SE-CNN:改进的SAR图像相干斑抑制算法

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兵器装备工程学报 2022年第11期43卷 103-111页

作者：张一铭赵生福郑鑫王艺博丁辉首都师范大学信息工程学院北京100048 高可靠嵌入式系统技术北京市工程研究中心北京100048

合成孔径雷达(SAR)的相干成像时,由于存在相干斑噪声,导致图像细节模糊,影响SAR图像的解译等后续应用。结合注意力机制,提出一种改进的下采样卷积神经网络D2SE-CNN。该方法在ID-CNN模型的基础上,去除估计噪声的残差连接;引入下采样,使... 详细信息

合成孔径雷达(SAR)的相干成像时,由于存在相干斑噪声,导致图像细节模糊,影响SAR图像的解译等后续应用。结合注意力机制,提出一种改进的下采样卷积神经网络D2SE-CNN。该方法在ID-CNN模型的基础上,去除估计噪声的残差连接;引入下采样,使原图重新排列成四个子图,扩大感受野;并添加挤压与激励块(SE)注意力模块,从而实现相干斑的抑制。为了验证算法的有效性,在BSDS500及NWPUVHR-10数据集和真实SAR图像上与主流方法进行了比较,实验结果表明,所提模型在PSNR、SSIM、ENL、Cv多个评价指标上得到较好的提升。

关键词： SAR图像卷积神经网络相干斑抑制挤压与激励块图像质量增强

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基于数据对象规模的Rank级内存分配方法

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计算机研究与发展 2014年第3期51卷 672-680页

作者：钟祺王晶管雪涛黄涛王克义北京大学微处理器研究开发中心北京100871 首都师范大学高可靠嵌入式系统技术北京市工程技术研究中心北京100048

利用主存的多bank/rank/channel结构挖掘访存并行性和局部性,是提高系统性能的重要手段.相关研究工作通过sub-rank技术增加可并行工作的存储资源,或在并行程序之间对bank划分,以隔离访存冲突.但上述方法没有考虑在bank/rank资源共存的... 详细信息

利用主存的多bank/rank/channel结构挖掘访存并行性和局部性,是提高系统性能的重要手段.相关研究工作通过sub-rank技术增加可并行工作的存储资源,或在并行程序之间对bank划分,以隔离访存冲突.但上述方法没有考虑在bank/rank资源共存的情况下,单个程序内部数据对象间的冲突问题.通过观察数据在主存中的分布,发现程序的数据倾向聚簇于单个rank中,并提出了一种基于数据对象规模的rank级内存分配方法(data object scale aware rank-level memory allocation,DSRA).DSRA将冲突开销较大的数据对象分散到不同的rank,利用增长的bank/rank资源提高访存性能.DSRA工作在操作系统层,基于编译器和操作系统提供的信息来分析数据对象间的冲突开销,既不用修改源码,也不依赖特殊的底层硬件.基于2款真实处理器对来自NAS Benchmark和SPEC CPU2000中的存储敏感型基准测试程序进行评测.结果表明,在不影响cache失效率的情况下,DSRA通过减少主存访问周期数,可以降低程序的执行时间.与已有的优化技术相比,性能平均提高6.8%,最高性能提升幅度为16%.

关键词：访存冲突操作系统 rank聚簇内存分配数据对象

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平面并联机构的形式化建模与验证

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小型微型计算机系统 2020年第5期41卷 925-931页

作者：陈琦王国辉张倩颖施智平陈善言关永高可靠嵌入式系统技术北京市工程研究中心首都师范大学信息工程学院北京100048

平面并联机构运动学分析是机构学研究热点之一,平面并联机构运动学模型的构建和求解的错误会给整个系统带来灾难性损失.传统运动学分析方法难以保证模型的完备性和求解的正确性.而基于高阶逻辑的定理证明方法可以弥补传统分析方法的不足... 详细信息

平面并联机构运动学分析是机构学研究热点之一,平面并联机构运动学模型的构建和求解的错误会给整个系统带来灾难性损失.传统运动学分析方法难以保证模型的完备性和求解的正确性.而基于高阶逻辑的定理证明方法可以弥补传统分析方法的不足.本文以几何代数、共形几何代数的高阶逻辑表达为基础,在HOL Light定理证明器中形式化描述平面并联机构的相关数学理论,建立正向运动学高阶逻辑模型,验证正向运动学的一般性求解算法,从而确保了平面并联机构运动学分析的正确性和分析求解方法的可靠性.

关键词：并联机构共形几何代数 HOL Light 形式化验证

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群机器人区域覆盖算法高阶逻辑建模与验证

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小型微型计算机系统 2022年第3期43卷 475-482页

作者：尹晓娜王国辉施智平关永张倩颖张景芝高可靠嵌入式系统技术北京市工程研究中心首都师范大学信息工程学院北京100048

区域覆盖算法广泛用于群机器人解决资源勘查、目标搜救、地形测绘等问题.目前,对区域覆盖算法的研究主要是用传统计算机仿真和数值计算方法对算法模型进行测试,然而,软件系统缺陷可能会使测试结果出现偏差,导致任务失败.因此,本文采用... 详细信息

区域覆盖算法广泛用于群机器人解决资源勘查、目标搜救、地形测绘等问题.目前,对区域覆盖算法的研究主要是用传统计算机仿真和数值计算方法对算法模型进行测试,然而,软件系统缺陷可能会使测试结果出现偏差,导致任务失败.因此,本文采用定理证明的形式化方法,基于交互定理证明器HOL-Light中集合库、实分析库等定理证明库,实现了群机器人工作场景的高阶逻辑表达;完成了机器人移动概率和平均移动概率的建模与验证;最终验证了一定时间步长内群机器人在特定区域内的覆盖率的正确性.为实现多种复杂场景下群机器人区域覆盖算法的高阶逻辑定理证明形式化分析奠定基础.

关键词：群机器人区域覆盖高阶逻辑定理证明形式化验证

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UM-BUS总线传输系统的建模与仿真

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电子技术应用 2015年第4期41卷 32-35页

作者：王钊张伟功首都师范大学信息工程学院北京100048 北京市高可靠嵌入式系统技术工程研究中心北京100048

UM-BUS(动态可重构高速串行总线)是一种基于故障实时检测和动态重构的新型多通道高速串行总线。UM-BUS总线的传输介质为屏蔽双绞线,传输通道采用MLVDS(TIA/EIA-899-2002)信号传送方式,能够支持多个节点设备直接连接。基于传输线理论,采... 详细信息

UM-BUS(动态可重构高速串行总线)是一种基于故障实时检测和动态重构的新型多通道高速串行总线。UM-BUS总线的传输介质为屏蔽双绞线,传输通道采用MLVDS(TIA/EIA-899-2002)信号传送方式,能够支持多个节点设备直接连接。基于传输线理论,采用Hyperlynx建立了UM-BUS总线物理线路的电阻隔离型、电容隔离型、阻容隔离型3种传输模型,并对仿真眼图及实测眼图进行了分析,确定了UM-BUS总线物理链路模型,为进一步研究UM-BUS总线传输系统提供了支持。

关键词：建模仿真眼图动态可重构高速串行总线 Hyperlynx

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