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AND代表“并且”；OR代表“或者”；NOT代表“不包含”；(注意必须大写,运算符两边需空一格)

检索范例：

范例一：(K=图书馆学 OR K=情报学) AND A=范并思 AND Y=1982-2016
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检索条件"机构=Department of Chip Design for Embedded Computing"

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On RTL to TLM abstraction to benefit simulation performance and modeling productivity in NoC design exploration 11

On RTL to TLM abstraction to benefit simulation performance ...

引用

11th International Conference on Principles and Practices of Programming on the Java Platform: Virtual Machines, Languages, and Tools, PPPJ 2014

作者： Horsinka, Sven Alexander Meyer, Rolf Wagner, Jan Buchty, Rainer Berekovic, Mladen Department of Chip Design for Embedded Computing Technische Universität Braunschweig BraunschweigD-38106 Germany

ISBN: (纸本)9781450329262

Growing demand to integrate more functionality into single-chip solutions require novel network-based interconnection models. The resulting increase in design complexity and strict time-to-market restrictions endanger the viability of Register Transfer Level (RTL) centric design processes in the future. To counteract these developments, the abstract design methodologies presented by Transaction Level Modeling (TLM 2.0/SystemC) are gaining popularity. With this paper, we demonstrate the benefits of raising the abstraction level by creating an adjustable Network on chip (NoC) simulation model, satisfying the diverse needs of software and system engineers. Based on a proven and tested RTL NoC design, we applied modeling methods defined in the TLM 2.0 standard, creating flexible simulation model. It provides high timing accuracy, enabling precise behavioral and performance analysis. In addition, higher simulation speeds are achieved by adjusting the timing accuracy. The results demonstrate the advantages of variable simulation accuracy: simulation runs are accelerated by more than two orders of magnitude with performance and behavior assessment exposing a limited latency error of less than four clock cycles compared to the RTL model. Copyright 2014 ACM.

关键词： Network-on-chip

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IDAMC: A many-core platform with run-time monitoring for mixed-criticality

IDAMC: A many-core platform with run-time monitoring for mix...

引用

IEEE 14th International Symposium on High-Assurance Systems Engineering, HASE 2012

作者： Motruk, Boris Diemer, Jonas Buchty, Rainer Ernst, Rolf Berekovic, Mladen Institute of Computer and Network Engineering Technische Universität Braunschweig Germany Department of Chip Design for Embedded Computing Technische Universität Braunschweig Germany

ISBN: (纸本)9780769549125

On a multi- or many-core platform that runs applications of different safety criticality (mixed-criticality), all applications have to be certified to the highest level of criticality, unless they are sufficiently isolated. Isolation enables individual certification of applications and cost-efficient re-certification of single applications after an update. We introduce a parameterizable and synthesizable many-core platform with a fast and scalable monitoring and control mechanism that supports safe sharing of resources. Our contribution is a step towards exploiting the benefits of multi- and many-core platforms for mixed-critical applications. © 2012 IEEE.

关键词： Criticality (nuclear fission)

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