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Running order statistics on a bit-level systolic array  4th
Running order statistics on a bit-level systolic array
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4th International Workshop on Parallel processing by Cellular Automata and Arrays, Parcella 1988
作者： Petkov, N. Int’l Lab. Image Processing and Computer Graphics Central Institute of Cybernetics and Information Processes Kurstr. 33 P.O. Box 1298 BerlinDDR-1086 Germany
A two-dimensional bit-level systolic array for running order statistics is presented. Both word-level and bit-level parallelism are employed. The array is extremely easy to implement in VLSI, because its cells are ver... 详细信息
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