检索结果-内蒙古大学图书馆

园艺与种苗 2019年第2期39卷 53-57页

作者：彭秀媛王枫周国民中国农业科学院农业信息研究所北京100081 辽宁省农业科学院信息所辽宁沈阳110161 中共辽宁省委党校信息中心辽宁沈阳110004

[目的/意义]针对农业科学数据共享技术解决方案不系统、对数据重用支撑不足、效率不高的问题,开展了农业科学数据技术系统研究工作,具有重要的理论和实践意义。[方法/过程]以农业科学数据为研究对象,针对农业科学数据共享技术解决方案... 详细信息

[目的/意义]针对农业科学数据共享技术解决方案不系统、对数据重用支撑不足、效率不高的问题,开展了农业科学数据技术系统研究工作,具有重要的理论和实践意义。[方法/过程]以农业科学数据为研究对象,针对农业科学数据共享技术解决方案存在的问题,提出了"三位一体"的农业科学数据共享技术系统,有机结合了数据增强技术、数据互操作技术和数据重用效果评估技术三部分,并设计了每部分的技术路线或框架。[结果/结论]初步解决了农业科学数据共享中存在的技术问题,有效支撑了农业科学数据重用。

关键词：农业科学数据共享技术系统数据增强互操作数据重用

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数据处理方法和装置、电子设备、存储介质

数据处理方法和装置、电子设备、存储介质

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作者：李秀红梁云颜深根张衡贾连成 200233 上海市徐汇区桂平路391号3号楼1605A室

本公开实施例公开了一种数据处理方法和装置、电子设备、存储介质，其中，方法包括：基于待处理数据的大小和卷积核的大小，确定待处理数据对应的转换结果矩阵中至少一个第二数据块对待处理数据中的第一数据块的数据重用关系，基于转换... 详细信息

标准号: CN109885407B

本公开实施例公开了一种数据处理方法和装置、电子设备、存储介质，其中，方法包括：基于待处理数据的大小和卷积核的大小，确定待处理数据对应的转换结果矩阵中至少一个第二数据块对待处理数据中的第一数据块的数据重用关系，基于转换结果矩阵中至少一个第二数据块对待处理数据中的第一数据块的数据重用关系，对待处理数据进行转换处理，得到转换结果矩阵，由于存在数据重用关系，加快了获得转换结果矩阵的速度，降低了将卷积计算转换为矩阵乘法的难度；对转换结果矩阵和卷积核进行矩阵乘法操作，获得待处理数据的卷积结果。

关键词：矩阵转换结果待处理数据处理数据数据重用第一数据矩阵乘法卷积核数据块方法和装置存储介质电子设备卷积计算转换处理数据处理卷积转换

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用于卷积神经网络加速器的高效率数据动态存储分配方法

用于卷积神经网络加速器的高效率数据动态存储分配方法

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作者：张萌王党辉张盛兵丁汇李楚曦姚腾腾朱挺王淼 710072 陕西省西安市友谊西路127号

本发明公开了一种用于卷积神经网络加速器的高效率数据动态存储分配方法，该方法将片外存储空间分配为五个层级：功能区、网络层、数据块、数据点/输出组、分通道区/输入组，每一级在前一级的基础上依据卷积神经网络的数据特征进行分配... 详细信息

标准号: CN112506436A

本发明公开了一种用于卷积神经网络加速器的高效率数据动态存储分配方法，该方法将片外存储空间分配为五个层级：功能区、网络层、数据块、数据点/输出组、分通道区/输入组，每一级在前一级的基础上依据卷积神经网络的数据特征进行分配。通过对五级地址空间的协同控制，有效组织卷积神经网络计算的中间数据，提高数据重用效率。本发明通过利用存储空间保存卷积特征的方法将层间数据组织成具有卷积计算和数据流特征的形式，减少片内数据重组织控制开销的同时缩短加速器计算流水总周期数，提高加速器计算性能。

关键词：卷积神经网络加速器片外存储空间数据流特征存储分配存储空间地址空间计算性能卷积计算数据动态数据特征数据重用数据组织协同控制有效组织中间数据总周期数分通道高效率功能区每一级前一级输出组输入组数据点数据块网络层重组织层级层间分配卷积流水保存

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用于硬件加速器的存储—计算模块互联电路自动设计方法

用于硬件加速器的存储—计算模块互联电路自动设计方法

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作者：梁云贾连成 100871 北京市海淀区颐和园路5号

本发明公布了一种用于硬件加速器的存储—计算模块互联电路自动设计方法，通过时空变换STT对数据在硬件加速器存储模块中的预期行为进行分析，对存储模块中的数据重用进行计算并分类，进一步自动选择最优存储‑计算模块互联电路方式并实... 详细信息

标准号: CN114462340A

本发明公布了一种用于硬件加速器的存储—计算模块互联电路自动设计方法，通过时空变换STT对数据在硬件加速器存储模块中的预期行为进行分析，对存储模块中的数据重用进行计算并分类，进一步自动选择最优存储‑计算模块互联电路方式并实现组播互联或旋转互联。本发明能够有效的提升硬件存储—计算模块的互联效率，减少了对存储资源的消耗。

关键词：计算模块硬件加速器存储模块互联电路互联存储存储资源时空变换数据重用硬件存储预期行为自动设计自动选择组播消耗分类分析

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一种基于FPGA轻量级卷积加速器的设计方法

一种基于FPGA轻量级卷积加速器的设计方法

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作者：臧阳阳张菁张天驰 250022 山东省济南市市中区南辛庄西路

本发明公开了一种基于FPGA卷积加速的方法。首先通用处理器用于解析神经网络配置信息以及权值数据，并将神经网络配置信息以及权值数据写入RAM中，针对外存访问带宽限制，基于设计空间探索确定循环分块因子以最大化数据重用，从而提高... 详细信息

标准号: CN113112002A

本发明公开了一种基于FPGA卷积加速的方法。首先通用处理器用于解析神经网络配置信息以及权值数据，并将神经网络配置信息以及权值数据写入RAM中，针对外存访问带宽限制，基于设计空间探索确定循环分块因子以最大化数据重用，从而提高整个网络的运算性能。然后FPGA从RAM中读取配置信息，用于生成FPGA加速器，接着通用处理器读入图片信息，并把它写入DRAM中，然后FPGA加速器从DRAM中读取图片数据并开始计算，并把计算结果写入DRAM中。本发明加速器使得各层能够同时部署在FPGA芯片上，并以流水线的方式运行，提高了运算性能和数据吞吐率。

关键词：配置信息加速器读取写入通用处理器权值数据神经网络运算性能数据吞吐率带宽限制设计空间数据重用图片数据图片信息整个网络最大化读入分块卷积外存流水线解析部署探索访问

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一种面向卷积神经网络的低功耗电压可调卷积运算模块

一种面向卷积神经网络的低功耗电压可调卷积运算模块

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作者：龚宇刘波朱智洋徐亭亭杨军时龙兴 211189 江苏省南京市江宁区东南大学路2号

本发明公开了一种面向卷积神经网络的低功耗电压可调卷积运算模块，包括数据传输单元、电压可调缓存单元、卷积运算模块三部分。对于卷积神经网络，卷积运算占据整体运算量的一半以上，而卷积计算时图像数据矩阵中数据会被同一卷积核读... 详细信息

标准号: CN107229598B

本发明公开了一种面向卷积神经网络的低功耗电压可调卷积运算模块，包括数据传输单元、电压可调缓存单元、卷积运算模块三部分。对于卷积神经网络，卷积运算占据整体运算量的一半以上，而卷积计算时图像数据矩阵中数据会被同一卷积核读取多次，且存在多个卷积核对这些数据进行同时访问的情况，使数据重用频次进一步提高。由于数据矩阵中的数据重用频次存在较大差异，将重用频次相同或相近的数据存放在一起，根据缓存中数据重用频次的分布调节存储模块电压，可以降低卷积神经网络加速器的整体功耗。本发明提出的低功耗电压可调卷积运算模块可以根据不同重用次数，进行不同缓存区域的电压调节，用以完成不同规模及步长情况下的卷积运算。

关键词：卷积神经网络数据重用卷积运算低功耗积运算重用读取缓存卷积运算模块数据传输单元图像数据矩阵存储模块电压调节电压可调缓存单元缓存区域卷积计算数据矩阵整体功耗整体运算卷积核加速器卷积核对占据访问

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一种基于脉动阵列的深度可分离卷积实现方法

一种基于脉动阵列的深度可分离卷积实现方法

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作者：陆生礼张广明张娟庞伟 211189 江苏省南京市江宁区东南大学路2号

本发明公开了一种基于脉动阵列的深度可分离卷积实现方法，采用M行N列个处理单元(Processing Element，PE单元)构成脉动阵列结构：在水平方向上，相邻的PE单元之间相互连接，左侧的PE单元可以将数据传递给右侧的PE单元；在垂直方向上，... 详细信息

标准号: CN113313252B

本发明公开了一种基于脉动阵列的深度可分离卷积实现方法，采用M行N列个处理单元(Processing Element，PE单元)构成脉动阵列结构：在水平方向上，相邻的PE单元之间相互连接，左侧的PE单元可以将数据传递给右侧的PE单元；在垂直方向上，每个PE单元有各自的数据输入端口和数据输出端口。数据预取模块为计算阵列提供特征图数据和权重参数。加法树对每一列PE单元并行输出的部分和数据进行累加。每个PE单元内部主要由寄存器、数据选择器、加法器和乘法器构成。本发明采用上述结构的脉动阵列并配合数据预取模块和加法树，可以实现不同的数据流和数据重用方式，从而实现对标准卷积、点卷积和深度卷积的加速计算。

关键词：卷积脉动阵列数据预取加法树脉动阵列结构数据输出端口数据输入端口数据选择器处理单元权重参数数据传递数据重用数据流乘法器寄存器加法器可分离特征图累加并行输出配合

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一种基于FPGA的CNN-SVM资源高效型加速架构

一种基于FPGA的CNN-SVM资源高效型加速架构

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作者：付平吴瑞东刘冰周彦臻高丽娜王宾涛陈浩林 150001 黑龙江省哈尔滨市南岗区西大直街92号

本发明是一种基于FPGA的CNN‑SVM资源高效型加速架构。本发明涉及嵌入式目标分类、检测技术领域，本发明所述架构包括处理器系统和可编程逻辑系统；所述CNN‑SVM流式架构加速器基于通用的加速算子结构，所述加速算子结构为多个乘累加MAC... 详细信息

标准号: CN112306951B

本发明是一种基于FPGA的CNN‑SVM资源高效型加速架构。本发明涉及嵌入式目标分类、检测技术领域，本发明所述架构包括处理器系统和可编程逻辑系统；所述CNN‑SVM流式架构加速器基于通用的加速算子结构，所述加速算子结构为多个乘累加MAC节点组成的二维阵列，该加速架构可以充分利用数据重用特性，并适用于CNN‑SVM混合算法中包括CNN，FC全连接层和SVM在内的不同类型的层。此外，加速架构中设计的通用算子的流水线间隔可以保持在单个时钟周期从而可以提高加速器的计算效率。

关键词：架构算子结构加速器可编程逻辑系统检测技术领域处理器系统二维阵列混合算法计算效率目标分类时钟周期数据重用高效型连接层嵌入式通用的累加算子流式流水线通用

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用于硬件加速器的存储—计算模块互联电路自动设计方法

用于硬件加速器的存储—计算模块互联电路自动设计方法

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作者：梁云贾连成 100871 北京市海淀区颐和园路5号

标准号: CN114462340B

关键词：计算模块硬件加速器存储模块互联电路互联存储存储资源时空变换数据重用硬件存储预期行为自动设计自动选择组播消耗分类分析

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一种稠密卷积运算核心的低功耗方法

一种稠密卷积运算核心的低功耗方法

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作者：林蓉芬袁欣辉尹万旺魏迪王飞孙浩男孙强史俊达 214038 江苏省无锡市滨湖区山水东路699号

本发明公开一种稠密卷积运算核心的低功耗方法，包括以下步骤：S1、分析平台指令特点，得到指令流数据重用高的数据存储格式P；S2、判断卷积输入数据是否为P存储格式，如果是，则跳转到S3；S3、将输入数据整理成P存储格式；S4、在指令... 详细信息

标准号: CN114217686A

本发明公开一种稠密卷积运算核心的低功耗方法，包括以下步骤：S1、分析平台指令特点，得到指令流数据重用高的数据存储格式P；S2、判断卷积输入数据是否为P存储格式，如果是，则跳转到S3；S3、将输入数据整理成P存储格式；S4、在指令级通过数据重用调用P存储格式的运算核心进行运算。本发明在不损失高功耗课题效率的同时，显著降低了对存储部件的数据访存频次，从而降低存储部件数据访问的功耗，进而显著降低高功耗课题的CPU运行功耗，缓解功耗墙难题、节约能耗。

关键词：存储格式存储部件数据重用高功耗功耗指令数据存储格式分析平台卷积运算数据访问运算核心运行功耗低功耗指令流卷积跳转调用稠密运算能耗节约缓解

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