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T=题名（书名、题名），A=作者（责任者），K=主题词，P=出版物名称，PU=出版社名称，O=机构（作者单位、学位授予单位、专利申请人），L=中图分类号，C=学科分类号，U=全部字段，Y=年（出版发行年、学位年度、标准发布年）

检索规则说明：

AND代表“并且”；OR代表“或者”；NOT代表“不包含”；(注意必须大写,运算符两边需空一格)

检索范例：

范例一：(K=图书馆学 OR K=情报学) AND A=范并思 AND Y=1982-2016
范例二：P=计算机应用与软件 AND (U=C++ OR U=Basic) NOT K=Visual AND Y=2011-2016

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文献类型

16 篇 专利

馆藏范围

16 篇 电子文献
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日期分布

机构

2 篇 通快激光有限责任...
2 篇 睿力集成电路有限...
2 篇 深圳市华星光电半...
2 篇 加利福尼亚太平洋...
2 篇 武汉华星光电半导...
1 篇 山东全寻智能科技...
1 篇 上海北大方正科技...
1 篇 山东华菱电子有限...
1 篇 深圳创维-rgb电子...
1 篇 英特尔公司
1 篇 长鑫存储技术有限...

作者

2 篇 r·弗莱格
2 篇 s·特纳
2 篇 d·格兰克
2 篇 邓永祺
2 篇 j·科拉奇
2 篇 李骏
2 篇 o·拉普
2 篇 柴立
2 篇 s·沃伦
1 篇 初立峰
1 篇 张文波
1 篇 s·陈
1 篇 邢培宏
1 篇 请求不公布姓名
1 篇 邢建昌
1 篇 傅晓立
1 篇 刘平
1 篇 邢转义
1 篇 a·k·马丁
1 篇 汤士东

语言

16 篇 中文

检索条件"主题词=时钟信号线路"

共 16 条记录，以下是1-10 订阅

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一种时钟信号线路、栅极驱动电路及显示面板

一种时钟信号线路、栅极驱动电路及显示面板

引用

作者：邓永祺柴立 518132 广东省深圳市光明新区公明街道塘明大道9-2号

本发明提供了一种时钟信号线路、栅极驱动电路及显示面板，涉及显示技术领域。其中时钟信号线路包括M根时钟信号线，每根时钟信号线均包括主线和支线，支线与主线的每个相交处的电容均相等，M根主线的线宽逐渐增大，其中，M为大于零的... 详细信息

标准号: CN113419366A

本发明提供了一种时钟信号线路、栅极驱动电路及显示面板，涉及显示技术领域。其中时钟信号线路包括M根时钟信号线，每根时钟信号线均包括主线和支线，支线与主线的每个相交处的电容均相等，M根主线的线宽逐渐增大，其中，M为大于零的整数。本发明提供的时钟信号线路能够保证时钟信号线之间RC Delay的一致性，以改善点灯画面水平密集线状不良的问题。

关键词：时钟信号线路时钟信号线主线栅极驱动电路画面水平显示面板逐渐增大电容密集线相交处线宽点灯相等保证

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一种时钟信号线路、栅极驱动电路及显示面板

一种时钟信号线路、栅极驱动电路及显示面板

引用

作者：邓永祺柴立 518132 广东省深圳市光明新区公明街道塘明大道9-2号

标准号: CN113419366B

关键词：时钟信号线路时钟信号线主线栅极驱动电路画面水平显示面板逐渐增大电容密集线相交处线宽点灯相等保证

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延迟锁相环时钟线路及半导体存储器

延迟锁相环时钟线路及半导体存储器

引用

作者：请求不公布姓名 230000 安徽省合肥市经济技术开发区翠微路6号海恒大厦630室

本发明公开了延迟锁相环时钟线路，包括：延迟锁相环，其能够相应于外部系统产生时钟信号；时钟线路控制系统，接收从所述延迟锁相环传输的时钟信号；高位数据端口部分，接收从所述时钟线路控制系统传输的时钟信号，并且用于与外部系统... 详细信息

标准号: CN107592110B

本发明公开了延迟锁相环时钟线路，包括：延迟锁相环，其能够相应于外部系统产生时钟信号；时钟线路控制系统，接收从所述延迟锁相环传输的时钟信号；高位数据端口部分，接收从所述时钟线路控制系统传输的时钟信号，并且用于与外部系统交换处于高位的数据位宽信号；以及低位数据端口部分，接收从所述时钟线路控制系统传输的时钟信号，并且用于与外部系统交换处于低位的数据位宽信号，其中，从所述延迟锁相环到所述高位数据端口部分的时钟信号线路的最长路径长度与从所述延迟锁相环到所述低位数据端口部分的时钟信号线路的最长路径长度不同。本发明还公开了半导体存储器。本发明通过数据位宽信号来控制时钟线路的流向从而选择最优的时钟线路。

关键词：延迟锁相环时钟线路控制系统时钟信号数据位宽外部系统时钟信号线路低位数据高位数据长路径传输半导体存储器产生时钟信号控制时钟低位交换

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一种全光存储器阵列及方法

一种全光存储器阵列及方法

引用

作者：邢露文邢培宏刘平邢建昌邢转义 253000 山东省德州市德城区东方红路777号63号楼3单元601室

本发明属于全光信息计算领域，提供了一种全光存储器阵列及方法，包括多个存储单元，存储单元的一端连接输入信号、写控制信号、清楚信号和时钟信号，另一端连接输出信号总线，多个存储单元串联组成全光存储器阵列；所述存储单元包括输... 详细信息

标准号: CN117423371A

本发明属于全光信息计算领域，提供了一种全光存储器阵列及方法，包括多个存储单元，存储单元的一端连接输入信号、写控制信号、清楚信号和时钟信号，另一端连接输出信号总线，多个存储单元串联组成全光存储器阵列；所述存储单元包括输入信号线路、写控信号线路、清除信号线路、时钟信号线路和地址信号线路；采用多个存储单元串联组成全光存储器阵列，提高了存储数据的精度和范围，存储同样数量的信息，节省数据总线条数和地址总线N倍，提高了数据总线复用效率；数据线可根据需要读、写、清零结合地址总线进行灵活控制。

关键词：存储单元全光存储器地址总线信号线路一端连接串联地址信号线路时钟信号线路输出信号总线写控制信号存储数据复用效率灵活控制清除信号时钟信号数据总线信息计算数据线总线条清零全光存储

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延迟锁相环时钟线路及半导体存储器

延迟锁相环时钟线路及半导体存储器

引用

作者：不公告发明人 230000 安徽省合肥市经济技术开发区翠微路6号海恒大厦526室

本实用新型涉及延迟锁相环时钟线路及半导体存储器。延迟锁相环时钟线路包括：延迟锁相环，其能够相应于外部系统产生时钟信号；时钟线路控制系统，接收从所述延迟锁相环传输的时钟信号；高位数据端口部分，接收从所述时钟线路控制系统... 详细信息

标准号: CN207304523U

本实用新型涉及延迟锁相环时钟线路及半导体存储器。延迟锁相环时钟线路包括：延迟锁相环，其能够相应于外部系统产生时钟信号；时钟线路控制系统，接收从所述延迟锁相环传输的时钟信号；高位数据端口部分，接收从所述时钟线路控制系统传输的时钟信号，且用于与外部系统交换处于高位的数据位宽信号；低位数据端口部分，接收从时钟线路控制系统传输的时钟信号，且用于与外部系统交换处于低位的数据位宽信号，从延迟锁相环到高位数据端口部分的时钟信号线路的最长路径长度与从延迟锁相环到低位数据端口部分的时钟信号线路的最长路径长度不同。本实用新型通过数据位宽信号来控制时钟线路的流向从而选择最优的时钟线路。

关键词：延迟锁相环时钟线路控制系统时钟信号外部系统时钟信号线路本实用新型低位数据高位数据数据位宽长路径传输半导体存储器产生时钟信号控制时钟低位位宽交换

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接触式图像传感器读取装置

接触式图像传感器读取装置

引用

作者：张文波魏晓丽初立峰 264209 山东省威海市高技区火炬路北洋大楼

一种接触式图像传感器读取装置，涉及图像传感器，扫描开始信号接口通过电阻R1与传感器芯片IC1的扫描开始信号输入端相连接，传感器芯片IC1的扫描开始信号输出端与传感器芯片IC2的扫描开始信号输入断连接，依此扫描开始信号连接到各个... 详细信息

标准号: CN2632777Y

一种接触式图像传感器读取装置，涉及图像传感器，扫描开始信号接口通过电阻R1与传感器芯片IC1的扫描开始信号输入端相连接，传感器芯片IC1的扫描开始信号输出端与传感器芯片IC2的扫描开始信号输入断连接，依此扫描开始信号连接到各个传感器芯片IC的扫描开始输入端，时钟信号接口经电阻R2与各传感器芯片IC的时钟信号输入端相连接，扫描输出信号接口与各传感器芯片IC的扫描输出信号输出端相连接，电源正极与各传感器芯片IC的电源正极输入端相连接，电源负极与各传感器芯片IC的电源负极输入端相连接，电源的正负极之间接入电容C1，其主要结构特点是，时钟信号线路的末端与电源负极之间接入电阻R3，适用于各种接触式图像传感器读取装置。

关键词：传感器芯片扫描连接电源负极电阻接触式图像传感器扫描输出信号电源正极读取装置信号输入时钟信号接口时钟信号线路图像传感器信号输出端时钟信号信号接口输入端电容依此电源

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可切换时钟信号模式的驱动电路、显示面板以及显示装置

可切换时钟信号模式的驱动电路、显示面板以及显示装置

引用

作者：傅晓立 518052 广东省深圳市南山区粤海街道深南大道南创维大厦A座13-16楼

本实用新型公开了可切换时钟信号模式的驱动电路、显示面板以及显示装置，包括控制模块，电平转换模块，信号选择控制模块，以及信号通道开关模块；所述电平转换模块与所述控制模块以及所述信号通道开关模块耦接，并用于将所述控制模块... 详细信息

标准号: CN216435440U

本实用新型公开了可切换时钟信号模式的驱动电路、显示面板以及显示装置，包括控制模块，电平转换模块，信号选择控制模块，以及信号通道开关模块；所述电平转换模块与所述控制模块以及所述信号通道开关模块耦接，并用于将所述控制模块发出的阵列基板行驱动信号转化为多个时钟信号，且输送到所述信号通道开关模块上多个对应的时钟信号线路上；所述信号选择控制模块与所述控制模块以及所述信号通道开关模块耦接，并用于接收到所述控制模块的控制信号后控制所述信号通道开关模块使相应的所述时钟信号线路开启。解决现有技术中的通过不同的逻辑控制板匹配相应的时钟信号模式，造成逻辑控制板的重复设计，导致资源的浪费的问题。

关键词：控制模块开关模块信号通道时钟信号电平转换模块时钟信号线路逻辑控制板信号选择耦接阵列基板行驱动本实用新型控制信号驱动电路显示面板显示装置信号转化可切换匹配重复

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激光脉冲发生器和用于产生激光脉冲的方法

激光脉冲发生器和用于产生激光脉冲的方法

引用

作者： R·弗莱格 D·格兰克 O·拉普德国施兰贝格

一种激光脉冲发生器(100，200)，所述激光脉冲发生器具有：a.脉冲形状发生装置(2)，其具有i.用于存储数据的脉冲形状存储器(3)和与所述脉冲形状存储器连接的数字/模拟转换器(DAC)(4)，ii.用于连接开始信号路径(7)的开始信号线路(6)的第... 详细信息

标准号: CN109478760A

一种激光脉冲发生器(100，200)，所述激光脉冲发生器具有：a.脉冲形状发生装置(2)，其具有i.用于存储数据的脉冲形状存储器(3)和与所述脉冲形状存储器连接的数字/模拟转换器(DAC)(4)，ii.用于连接开始信号路径(7)的开始信号线路(6)的第一接头(5)，iii.用于连接时钟信号线路(9)的第二接头(8)，iv.用于连接脉冲线路(12)的第三接头(11)，其中，所述第一和第二接头(5，8)如此与所述脉冲形状存储器(3)和所述DAC(4)连接，使得在预给定的开始信号的情况下数据从所述脉冲形状存储器(3)被导至所述DAC(4)并且被所述DAC(4)尤其以时钟信号的时钟转换成输出脉冲，所述输出脉冲被提供在所述第三接头(11)上以便控制用于激光二极管(14)的驱动器(13)；b.时钟单元(10)，所述时钟单元与所述第二接头(8)通过所述时钟信号线路(9)连接；其特征在于，c.所述时钟单元(10)具有复位接头(105)，所述复位接头与所述开始信号路径(7)连接。

关键词：脉冲形状存储器开始信号时钟单元激光脉冲发生器时钟信号线路输出脉冲复位数字/模拟转换器驱动器连接开始信号存储器连接激光二极管存储数据发生装置脉冲线路时钟信号时钟转换预给定

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一种驱动电路

一种驱动电路

引用

作者：李骏 430070 湖北省武汉市东湖新技术开发区高新大道666号光谷生物创新园C5栋305室

本发明实施例公开了一种驱动电路，包括：第一驱动器和第二驱动器，用于在所述驱动电路中驱动开关电源导通或关闭；第三驱动器，用于替换失效的所述第一驱动器；所述第二驱动器与所述第一驱动器连接；第一时钟信号线路和第二时钟信号线... 详细信息

标准号: CN108010490A

本发明实施例公开了一种驱动电路，包括：第一驱动器和第二驱动器，用于在所述驱动电路中驱动开关电源导通或关闭；第三驱动器，用于替换失效的所述第一驱动器；所述第二驱动器与所述第一驱动器连接；第一时钟信号线路和第二时钟信号线路，用于向所述第一驱动器和所述第二驱动器提供时钟信号；第一修复线路和第二修复线路，用于在所述第一驱动器失效时，将所述第三驱动器与所述第一驱动器的失效端口连接。本发明实施例通过增加备用的驱动器，可以对驱动电路中失效的驱动器进行修复。

关键词：驱动器驱动电路时钟信号线路修复驱动器连接电源导通驱动开关失效端口时钟信号备用替换

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延迟锁相环时钟线路及半导体存储器

延迟锁相环时钟线路及半导体存储器

引用

作者：不公告发明人 230000 安徽省合肥市经济技术开发区翠微路6号海恒大厦526室

标准号: CN107592110A

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