检索结果-内蒙古大学图书馆

计量学报 2024年第5期45卷 619-625页

作者：梁起铭韩琪娜施杨周琨荔杨雁徐睿金尚忠赵建亭屈继峰中国计量大学浙江杭州310018 中国计量科学研究院北京100029 哈尔滨工业大学黑龙江哈尔滨150001

相比于用传统半导体器件研制的信号源,约瑟夫森任意波形发生器合成信号的幅值可溯源至自然常数,其输出波形具有超低噪声、超低失真的优点。使用约瑟夫森任意波形发生器评估了National Instruments公司24位数字采集卡PXI 5922的性能。其... 详细信息

相比于用传统半导体器件研制的信号源,约瑟夫森任意波形发生器合成信号的幅值可溯源至自然常数,其输出波形具有超低噪声、超低失真的优点。使用约瑟夫森任意波形发生器评估了National Instruments公司24位数字采集卡PXI 5922的性能。其中,采用零补偿波形合成方法简化系统硬件结构,并且使用高精度、多比例的感应分压器提升评估效率。首先,在10 kHz的带宽内标定了PXI 5922单通道的增益及其稳定性、信噪比、无杂散动态范围、总谐波失真、信纳比和有效位数;其次,标定了PXI 5922两通道不同相位下的相位差;最后,结合电网的谐波情况,以60 Hz的基波频率为例,标定了PXI 5922在12阶谐波以内各谐波的幅度与相位响应。约瑟夫森任意波形发生器的超高精度和宽带输出能力在评估高精度模数转换器的性能方面具有广阔的应用前景。

关键词：电学计量模数转换器约瑟夫森任意波形发生器零补偿感应分压器

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一种10bit 50MS/s低功耗流水线模数转换器

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复旦学报（自然科学版） 2011年第4期50卷 450-456页

作者：周文君张科李文宏复旦大学专用集成电路与系统国家重点实验室上海201203

设计了一个10 bit精度,50 MS/s采样频率的流水线型模数转换器,通过运算放大器共享和省略采样保持实现低功耗.第1级为单比特输出,它能够在将信号摆幅减半的同时保持信噪比不衰减,减半的摆幅使得运放直流增益和带宽要求以及电容匹配要求降... 详细信息

设计了一个10 bit精度,50 MS/s采样频率的流水线型模数转换器,通过运算放大器共享和省略采样保持实现低功耗.第1级为单比特输出,它能够在将信号摆幅减半的同时保持信噪比不衰减,减半的摆幅使得运放直流增益和带宽要求以及电容匹配要求降低.由于采用运放共享技术,该设计只使用了4个运放,功耗相比传统结构降低1/3.采用0.35μm 2P4M CMOS工艺设计,在3.3 V电源电压下约消耗33 mW功耗,核心部分面积为2.2 mm2,采样频率50 MS/s,输入频率5 MHz时,SFDR为80.27 dB,THD为-77.45 dB,SNDR为61.17 dB.

关键词：模数转换器流水线低功耗运放共享无采样保持

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一种用于14bit 50MHz流水线模数转换器的CMOS采样开关

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Journal of Semiconductors 2007年第9期28卷 1488-1493页

作者：胡晓宇周玉梅中国科学院微电子研究所北京100029

分析了影响CMOS采样开关性能的非理想因素,针对14bit50MHzA/D转换器对采样开关特性的要求,提出了一种新型的时钟馈通补偿结构.该结构通过增加dummy开关管能够有效消除时钟馈通对采样值的影响,打破了开关设计中速度和精度之间的制约关系... 详细信息

分析了影响CMOS采样开关性能的非理想因素,针对14bit50MHzA/D转换器对采样开关特性的要求,提出了一种新型的时钟馈通补偿结构.该结构通过增加dummy开关管能够有效消除时钟馈通对采样值的影响,打破了开关设计中速度和精度之间的制约关系.基于SMIC0.25μm标准CMOS数模混合工艺,采用Hspice对电路进行了模拟.模拟结果显示,在输入信号为23.3MHz正弦波,峰峰值为2V,采样时钟频率为50MHz,时钟上升/下降时间为0.1ns时,无杂散动态范围达到92dB,信噪失真比达到83dB;同时时钟馈通效应造成的保持误差由5.5mV降为90μV.这种具有时钟馈通补偿结构的采样开关特别适用于高速高分辨率模数转换器.

关键词：栅压自举采样开关非线性时钟馈通补偿保持误差模数转换器

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采用改进电流调制功耗缩放的精度和速度可编程流水线模数转换器

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Journal of Semiconductors 2008年第5期29卷 1010-1015页

作者：魏琦殷秀梅杨斌杨华中清华大学电子工程系电路与系统教研室北京100084

介绍了一个精度和速度可编程、但不需要改变运算放大器偏置电流的流水线模数转换器,实现了8~11bit和400k^40MSa/s的程控范围.提出了一种新颖的预充型开关运放,在降低功耗的同时,可以使运算放大器快速开启.通过采用改进的电流调制功耗缩... 详细信息

介绍了一个精度和速度可编程、但不需要改变运算放大器偏置电流的流水线模数转换器,实现了8~11bit和400k^40MSa/s的程控范围.提出了一种新颖的预充型开关运放,在降低功耗的同时,可以使运算放大器快速开启.通过采用改进的电流调制功耗缩放技术、新颖的开关运放技术、采样保持电路消去技术和动态比较器,大大降低了电路的功耗.电路设计采用1.8V 1P6M0.18μm CMOS工艺,仿真结果表明:在11bit,40MSa/s性能条件下,输入信号为19.02MHz时,无杂散动态范围(SFDR)为81dB,信噪失真比(SNDR)为67dB,功耗为29mW.

关键词：流水线模数转换器开关运算放大器

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低功耗33MHz采样频率,10比特流水线结构的模数转换器

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复旦学报（自然科学版） 2001年第3期40卷 335-341页

作者：程闪峰张洁闵昊复旦大学专用集成电路与系统国家重点实验室上海200433

介绍了一个 33MHz,10bit,3 3V流水线结构的模数转换器 (ADC) .该ADC采用了一种带预放大级的运算放大器和一种动态比较器来降低功耗 ;采用了电荷泵电路来提升时钟信号的电压 ;采用了一个恒跨导偏置电路 .本芯片在 0 35 μmCMOS工艺上实... 详细信息

介绍了一个 33MHz,10bit,3 3V流水线结构的模数转换器 (ADC) .该ADC采用了一种带预放大级的运算放大器和一种动态比较器来降低功耗 ;采用了电荷泵电路来提升时钟信号的电压 ;采用了一个恒跨导偏置电路 .本芯片在 0 35 μmCMOS工艺上实现 ,芯片面积为 1 2× 0 .4mm2 .芯片工作在 33MHz时功耗为 6 9 4mW ,采样 16MHz正弦信号时的信噪比 (SNDR)为 5 8 4dB .

关键词：模数转换器流水线动态比较器预放大器电荷泵模数转换电路

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一种采用时间交织结构的低功耗Pipelined SAR模数转换器设计

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复旦学报（自然科学版） 2015年第2期54卷 184-189页

作者：周浩沈骁樱陈迟晓叶凡任俊彦复旦大学专用集成电路与系统国家重点实验室上海201203

设计了一款低功耗12bit 100MS/s流水线逐次逼近型模数转换器(Pipelined SAR ADC),提出了一种第二级子模数转换器时间交织的结构,改善了模数转换器的采样率;优化Pipelined SAR ADC前后级子ADC的位数关系,同时结合半增益运算放大器技术,... 详细信息

设计了一款低功耗12bit 100MS/s流水线逐次逼近型模数转换器(Pipelined SAR ADC),提出了一种第二级子模数转换器时间交织的结构,改善了模数转换器的采样率;优化Pipelined SAR ADC前后级子ADC的位数关系,同时结合半增益运算放大器技术,降低了运放的设计难度,减小了运放的功耗.本设计是在TSMC65nm LP工艺下设计实现的,在电源电压为1.2V,采样率为100MS/s,输入信号为49.1MHz时,此ADC可达到69.44dB的信噪比(SNDR)和74.04dB的无杂散动态范围(SFDR),功耗为8.6mW.

关键词：模数转换器流水线逐次逼近低功耗

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一种应用于数字电源的模数转换器的设计

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复旦学报（自然科学版） 2014年第4期53卷 475-481,489页

作者：张国贤吴琦闵昊复旦大学专用集成电路与系统国家重点实验室上海201203

设计了一种应用于数字电源控制器的模数转换器,和传统的模数转换器不同,该模数转换器采用两步转换的结构,功耗低,面积小.通过模数转换器与数字脉宽调制器共用延迟锁定环,面积和功耗进一步降低;通过在斜波信号发生器中使用电流舵技术,提... 详细信息

设计了一种应用于数字电源控制器的模数转换器,和传统的模数转换器不同,该模数转换器采用两步转换的结构,功耗低,面积小.通过模数转换器与数字脉宽调制器共用延迟锁定环,面积和功耗进一步降低;通过在斜波信号发生器中使用电流舵技术,提高了斜波信号发生器的线性度;通过数字逻辑的优化设计,解决了时间数字转换中两步量化同步和匹配的问题.该模数转换器采样频率为1MS/s,目标有效位为8bit.芯片在SMIC0.13μm CMOS工艺下流片,功耗为60μW,面积为0.03mm2,有效位达到6.5bit.

关键词：数字电源模数转换器两步转换共用DLL

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一种12-bit 50-MS/s 4-mW带比较器失调校正的逐次逼近型模数转换器

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复旦学报（自然科学版） 2013年第3期52卷 314-320,327页

作者：林涛顾蔚如王明硕叶凡许俊任俊彦复旦大学专用集成电路与系统国家重点实验室上海201203

本文设计了一款低功耗12-bit 50-MS/s逐次逼近型模数转换器,提出了一种动态比较器失调电压校正技术,取代了采用预放大器降低比较器失调电压的传统方法,解决了比较器低功耗和高精度之间的矛盾;基于时分复用的方法,改进了转换器核心数字逻... 详细信息

本文设计了一款低功耗12-bit 50-MS/s逐次逼近型模数转换器,提出了一种动态比较器失调电压校正技术,取代了采用预放大器降低比较器失调电压的传统方法,解决了比较器低功耗和高精度之间的矛盾;基于时分复用的方法,改进了转换器核心数字逻辑,只需传统结构1/2的硬件电路便能实现相同的功能.此外,本文针对桥接电容和寄生电容引入的非线性问题做了详细的分析和公式推导.本设计采用SMIC 65nm标准CMOS工艺,核心芯片供电电压为1.2V,采样速率为50MS/s,版图后仿真结果表明,该ADC可达到71.5dB的信噪比和84.5dB的无杂散动态范围,功耗为4mW,芯片核心面积为0.3×0.2mm2.

关键词：逐次逼近型模数转换器桥接电容比较器失调校正时分复用

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一种用于流水线模数转换器的电容失配校准方法

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Journal of Semiconductors 2005年第9期26卷 1838-1842页

作者：李福乐王红梅李冬梅王志华清华大学微电子学研究所北京100084 清华大学电子工程系北京100084

对于流水线模数转换器(ADC),电容失配是一种主要的非线性误差源.为了减小电容失配误差,提出了一种电容失配校准的方法.该方法通过一种电荷相加、电容交换和电荷反转移的电路技术,可将电容失配误差减小至其2次项.基于所提出的方法,设计... 详细信息

对于流水线模数转换器(ADC),电容失配是一种主要的非线性误差源.为了减小电容失配误差,提出了一种电容失配校准的方法.该方法通过一种电荷相加、电容交换和电荷反转移的电路技术,可将电容失配误差减小至其2次项.基于所提出的方法,设计了一种0.6μmCMOS,13b,2MS/s的流水线ADC实验芯片.对所设计的实验芯片进行测试,得到了0.5LSB的DNL和2.5LSB的INL,并且当以614kHz的采样率对19.2kHz的输入进行转换时,得到了71.2dB的SFDR和64.1dB的SNDR,当以2MHz的采样率对125kHz的输入进行转换时,得到了70.6dB的SFDR和62.22dB的SNDR.以上结果表明,ADC得到了超出电容匹配精度的线性度,证明了所采用的电容失配校准方法的有效性.

关键词：模数转换器流水线电容失配校准

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用于DTMB接收机的10bit,40MS/s,72dB SFDR流水线模数转换器

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Journal of Semiconductors 2008年第2期29卷 366-370页

作者：殷秀梅魏琦杨斌杨华中清华大学电子工程系北京100084

介绍了一个应用于数字电视地面多媒体广播(DTMB)接收机的10-bit,40-MS/s流水线模数转换器(ADC),通过优化各级电容大小和运算放大器电流大小,在保证电路性能的同时降低了功耗.测试结果为:在40MHz采样率,4.9MHz输入信号下,可以获得9.14bi... 详细信息

介绍了一个应用于数字电视地面多媒体广播(DTMB)接收机的10-bit,40-MS/s流水线模数转换器(ADC),通过优化各级电容大小和运算放大器电流大小,在保证电路性能的同时降低了功耗.测试结果为:在40MHz采样率,4.9MHz输入信号下,可以获得9.14bit的有效位数(ENOB),72.3dB无杂散动态范围(SFDR).电路微分非线性(DNL)的最大值为0.38LSB,积分非线性(INL)的最大值为0.51LSB.电路采用0.18μm1P6MCMOS工艺实现,电源电压为3.3V,核心面积为1mm2,功耗为78mW.

关键词：模数转换器流水线模数转换器无杂散动态范围

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