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AND代表“并且”；OR代表“或者”；NOT代表“不包含”；(注意必须大写,运算符两边需空一格)

检索范例：

范例一：(K=图书馆学 OR K=情报学) AND A=范并思 AND Y=1982-2016
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25 篇 专利

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25 篇 电子文献
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日期分布

机构

3 篇 山东大学
2 篇 武汉光庭科技有限...
2 篇 北京银联金卡科技...
2 篇 中国计量大学
2 篇 西安电子科技大学
2 篇 北京大学
2 篇 北京华能新锐控制...
2 篇 中国核电工程有限...
1 篇 兰州大学
1 篇 广西钢铁集团有限...
1 篇 瑞士优北罗股份有...
1 篇 广东小厨科技有限...
1 篇 北京理工大学
1 篇 柳州钢铁股份有限...
1 篇 合肥图哇科技有限...
1 篇 苏州新代数控设备...

作者

2 篇 徐辉
2 篇 田宏哲
2 篇 张永峰
2 篇 徐思敏
2 篇 孟飞宇
2 篇 胡子一
2 篇 雷杰
2 篇 王祖强
2 篇 吴卓铤
2 篇 崔凤玉
2 篇 渠韶光
2 篇 张鹏
2 篇 张兴
2 篇 孙衍琪
2 篇 麻红波
2 篇 苏睿之
2 篇 李丹阳
2 篇 李君
2 篇 胡盖
2 篇 李妙峰

语言

25 篇 中文

检索条件"主题词=编码器硬件"

共 25 条记录，以下是1-10 订阅

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详细简洁

排序：

一种基于FPGA的Transformer编码器硬件加速器及其计算方法

一种基于FPGA的Transformer编码器硬件加速器及其计算方法

引用

作者：周卫东周嘉琪邱富聪耿澔童赵良澎梁继尧程威 250100 山东省济南市历城区山大南路27号

本发明涉及一种基于FPGA的Vision Transformer编码器硬件加速器及其计算方法，包括：处理器模块、DDR内存模块、数据调度模块、矩阵存储模块、残差相加模块、第一矩阵乘法模块、GeLU运算模块、第二矩阵乘法模块、第三矩阵乘法模块、soft... 详细信息

标准号: CN117391096A

本发明涉及一种基于FPGA的Vision Transformer编码器硬件加速器及其计算方法，包括：处理器模块、DDR内存模块、数据调度模块、矩阵存储模块、残差相加模块、第一矩阵乘法模块、GeLU运算模块、第二矩阵乘法模块、第三矩阵乘法模块、softmax计算模块；处理器模块用于动态调度加速器并进行辅助计算，同时运算阵列采用输出固定的数据并行计算策略，网络规模适配能力强，输入输出数据复用程度高，片内外数据搬运高效。该硬件加速器属于Vision Transformer神经网络专用加速器，能够有效提高Vision Transformer神经网络的运算速度及效率，有效降低运算功耗。

关键词：矩阵乘法模块处理器模块神经网络加速器运算矩阵存储模块输入输出数据数据调度模块编码器硬件硬件加速器专用加速器并行计算动态调度计算模块输出固定数据搬运网络规模相加模块运算模块运算阵列能力强残差复用功耗适配

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一种基于FPGA的极化码编码器硬件实现方法

一种基于FPGA的极化码编码器硬件实现方法

引用

作者：王秀敏吴卓铤王怡李君洪波 310016 浙江省杭州市江干区学源街555号

本发明公开了一种基于FPGA的极化码编码器硬件实现方法，该方法主要针对极化码编码结构的前后级之间关联性较强所导致的并行结构设计困难等问题，在总结出极化码编码生成矩阵规律的基础上，设计出一种简化运算的方法。该方法只需进行生... 详细信息

标准号: CN108304658A

本发明公开了一种基于FPGA的极化码编码器硬件实现方法，该方法主要针对极化码编码结构的前后级之间关联性较强所导致的并行结构设计困难等问题，在总结出极化码编码生成矩阵规律的基础上，设计出一种简化运算的方法。该方法只需进行生成矩阵第一列的运算，而后根据规律可以得到整个编码结果。该方法在解决并行问题的基础上还引入了ROM查表法作为初始计算单元，从而大大提高了编码器整体的运算速度。

关键词：极化运算编码生成矩阵编码器硬件编码结构编码结果并行结构计算单元简化运算生成矩阵编码器查表法关联性并行引入

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一种基于FPGA的极化码编码器硬件实现方法

一种基于FPGA的极化码编码器硬件实现方法

引用

作者：王秀敏吴卓铤王怡李君洪波 310016 浙江省杭州市江干区学源街555号

标准号: CN108304658B

关键词：极化运算编码生成矩阵编码器硬件编码结构编码结果并行结构计算单元简化运算生成矩阵编码器查表法关联性并行引入

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基于电压比较器的编码器硬件滤波电路

基于电压比较器的编码器硬件滤波电路

引用

作者：谢磊田羽张亮 230088 安徽省合肥市高新区黄山路与天智路交口洪泰(中安)创新空间203室

本实用新型提供一种基于电压比较器的编码器硬件滤波电路，用于对编码器输出脉冲信号进行滤波，所述编码器具有至少一相输出脉冲信号，包括：RC滤波电路，该RC滤波电路的输入端作为编码器信号输入端；以及电压比较器电路，其中电压比较... 详细信息

标准号: CN217643308U

本实用新型提供一种基于电压比较器的编码器硬件滤波电路，用于对编码器输出脉冲信号进行滤波，所述编码器具有至少一相输出脉冲信号，包括：RC滤波电路，该RC滤波电路的输入端作为编码器信号输入端；以及电压比较器电路，其中电压比较器的同相输入端与所述RC滤波电路的输出端相连，电压比较器的反相输入端连接分压调节电路，电压比较器的输出端连接上拉电阻的第一端并作为编码器信号输出端，电压比较器的电源端与上拉电阻的第二端相连。本实用新型采用RC滤波电路和电压比较器电路组成的多级滤波电路的方式将干扰信号进行分级处理，能够滤除杂乱且连续的强干扰信号，有效的识别编码器信号，使得系统工作稳定。

关键词：电压比较器滤波电路编码器信号电压比较器电路本实用新型上拉电阻输入端编码器输出脉冲多级滤波电路分压调节电路编码器硬件反相输入端强干扰信号输出端连接输出端相连同相输入端分级处理干扰信号工作稳定输出脉冲编码器第一端电源端输出端滤波滤除

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JPEG-LS近无损图像压缩编码器硬件实现方法

JPEG-LS近无损图像压缩编码器硬件实现方法

引用

作者：雷杰张毅李云松贾超群张皓 710071 陕西省西安市太白南路2号

本发明公开了一种JPEG-LS近无损图像压缩编码器硬件实现方法，克服了现有技术中编码器处理速度慢，压缩性能差的缺点，本发明的具体步骤如下：(1)获得预测重建值；(2)像素预测；(3)获得上下文索引值；(4)获得像素残差；(5)重建值计算；... 详细信息

标准号: CN102970531B

本发明公开了一种JPEG-LS近无损图像压缩编码器硬件实现方法，克服了现有技术中编码器处理速度慢，压缩性能差的缺点，本发明的具体步骤如下：(1)获得预测重建值；(2)像素预测；(3)获得上下文索引值；(4)获得像素残差；(5)重建值计算；(6)参数更新；(7)误差映射；(8)Golomb编码；本发明相比于现有技术，具有处理速度快，压缩性能好，硬件实现复杂度低的优点。

关键词：处理速度像素无损图像压缩编码器硬件上下文索引参数更新硬件实现编码器复杂度重建映射

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JPEG-LS近无损图像压缩编码器硬件实现方法

JPEG-LS近无损图像压缩编码器硬件实现方法

引用

作者：雷杰张毅李云松贾超群张皓 710071 陕西省西安市太白南路2号

标准号: CN102970531A

关键词：处理速度像素无损图像压缩编码器硬件上下文索引参数更新硬件实现编码器复杂度重建映射

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一种对旋转编码器识别的改进方法

一种对旋转编码器识别的改进方法

引用

作者：朱敦尧李妙峰 430074 湖北省武汉市东湖新技术开发区关山大道特一号光谷软件园C6栋210

本发明涉及嵌入式Linux旋转编码器进行数据采集的方法，以及系统的软硬件设计、驱动程序开发和实际应用情况，得出了编码器进行数据采集的一种切实可行的方法。通过程序滤除和减少旋转编码器抖动带来的误操作。具体包括以下步骤：1)嵌入... 详细信息

标准号: CN102609258A

本发明涉及嵌入式Linux旋转编码器进行数据采集的方法，以及系统的软硬件设计、驱动程序开发和实际应用情况，得出了编码器进行数据采集的一种切实可行的方法。通过程序滤除和减少旋转编码器抖动带来的误操作。具体包括以下步骤：1)嵌入式Linux编译平台的搭建；2)编码器硬件电路：编码器采用一般的增量式旋转编码器；3)信号初始化及采集对比处理；4)信号传递：采集对比后的数据将会通过Linux编码器驱动传递到应用层；5)结束所有信号采集处理过程，等待下次动作。

关键词：编码器嵌入式Linux 旋转编码器数据采集增量式旋转编码器采集驱动程序开发信号采集处理编码器硬件软硬件设计信号传递应用情况初始化误操作抖动搭建编译电路

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一种无编码器的高精度控制方法及系统

一种无编码器的高精度控制方法及系统

引用

作者：吴庚民赵国良吕涛黄语强谢柳军王博陈俊黄竟云黄君 538000 广西壮族自治区防城港市港口区北部湾大道196号

本发明公开了一种无编码器的高精度控制方法包括：根据实际生产过钢情况，观察各项传动参数设定值；通过实时数据采集系统，同时读取现场编码器速度反馈值与编码器计算值进行实时对比；将传动参数的速度控制点由现场编码器数据反馈值控... 详细信息

标准号: CN116224842A

本发明公开了一种无编码器的高精度控制方法包括：根据实际生产过钢情况，观察各项传动参数设定值；通过实时数据采集系统，同时读取现场编码器速度反馈值与编码器计算值进行实时对比；将传动参数的速度控制点由现场编码器数据反馈值控制切换为编码器计算值控制，切换控制系统后，观察现场电机运行情况。本发明提供的无编码器的高精度控制方法采用传动柜CU单元编码器计算值进行闭环精确控制，消除了因编码器故障及更换编码器产生长时间故障时间制约生产的问题，满足轧制生产控制精度要求，减少了编码器硬件配置和复杂性，降低了编码器维护成本和备件成本；增强了系统的抗噪能力，进一步提升轧制生产运行的稳定可靠性。

关键词：编码器高精度控制现场编码器传动参数轧制生产实时数据采集系统闭环读取编码器故障编码器硬件单元编码器速度控制点稳定可靠性备件成本精度要求抗噪能力控制切换控制系统时间故障时间制约实时对比数据反馈速度反馈现场电机传动柜观察生产配置维护

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一种对旋转编码器识别的改进方法

一种对旋转编码器识别的改进方法

引用

作者：朱敦尧李妙峰 430074 湖北省武汉市东湖新技术开发区关山大道特一号光谷软件园C6栋210

标准号: CN102609258B

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一种基于FPGA的JPEG-LS编码器的实现方法

一种基于FPGA的JPEG-LS编码器的实现方法

引用

作者：刘贵鹏刘泽萍 730000 甘肃省兰州市城关区天水南路222号

本发明涉及一种基于FPGA的JPEG‑LS编码器的实现方法，依次包括上下文建模、边缘检测、自适应预测修正、预测残差计算、Golomb编码参数K计算、预测误差映射、对预测误差MErrval进行Golomb编码、上下文参数更新，以及码流拼接。本申请一... 详细信息

标准号: CN116828196A

本发明涉及一种基于FPGA的JPEG‑LS编码器的实现方法，依次包括上下文建模、边缘检测、自适应预测修正、预测残差计算、Golomb编码参数K计算、预测误差映射、对预测误差MErrval进行Golomb编码、上下文参数更新，以及码流拼接。本申请一方面能够完全不借助软件，只在硬件基础上实现JPEG‑ls无损高压缩率编码器功能。另一方面，舍弃了JPEG‑LS标准中的游程长度编码，降低了硬件实现的复杂性，减少了所设计编码器硬件资源的消耗，本申请还通过优化golomb编码参数K的计算以及golomb编码方式，最终得到压缩率为18%~25%的编码器。

关键词：预测误差编码器游程长度编码编码器功能编码器硬件上下文参数上下文建模自适应预测边缘检测硬件基础硬件实现预测残差高压缩压缩率码流映射拼接无损申请舍弃消耗修正更新优化

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